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406
AMD Geode SC1200/SC1201 Processor Data Book
Electrical Specifications
Revision 7.1
Figure 9-9. ACB Signals: Rising and Falling Timing Diagram
Figure 9-10. ACB Start and Stop Condition Timing Diagram
tSDAfo
AB1D/AB2D signal fall
time
300
ns
tSDAro
AB1D/AB2D signal rise
time
1
s
tSDAho
AB1D/AB2D hold time
7 * tCLK - tSCLfo
After AB1C/AB2C falling edge
tSDAvo
AB1D/AB2D valid time
7 * tCLK + tRD
After AB1C/AB2C falling edge
Note 1. K is determined by bits [7:1] of the ACBCTL2 register (LDN 05h/06h, Offset 05h).
Note 2. tSCLhigho value depends on the signal capacitance and the pull-up value of the relevant pin.
Table 9-19. ACCESS.bus Output Timing Parameters (Continued)
Symbol
Parameter
Min
Max
Unit
Comments
AB1D
tSDAr
0.7VIO
0.3VIO
tSDAf
0.7VIO
0.3VIO
AB1C
tSCLr
0.7VIO
0.3VIO
tSCLf
0.7VIO
0.3VIO
AB2D
AB2C
AB1D
AB1C
tCSTOsi
tBUFi
tDLCs
tCSTRhi
Start Condition
Stop Condition
tDLCo
tCSTOso
tBUFo
tCSTRho
AB2D
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