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參數(shù)資料
| 型號： | SAFC165UTAH |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT |
| 中文描述： | 嵌入式的C166與國際移民組織的USART - 2和HDLC支持 |
| 文件頁數(shù)： | 60/539頁 |
| 文件大小： | 8071K |
| 代理商： | SAFC165UTAH |
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C165UTAH
Central Processor Unit
Data Sheet
60
2001-02-23
Particular Pipeline Effects
Since up to four different instructions are processed simultaneously, additional hardware
has been spent in the C165UTAH to consider all causal dependencies which may exist
on instructions in different pipeline stages without a loss of performance. This extra
hardware (ie. for 'forwarding' operand read and write values) resolves most of the
possible conflicts (eg. multiple usage of buses) in a time optimized way and thus avoids
that the pipeline becomes noticeable for the user in most cases. However, there are
some very rare cases, where the circumstance that the C165UTAH is a pipelined
machine requires attention by the programmer. In these cases the delays caused by
pipeline conflicts can be used for other instructions in order to optimize performance.
Context Pointer Updating
An instruction, which calculates a physical GPR operand address via the CP register, is
mostly not capable of using a new CP value, which is to be updated by an immediately
preceding instruction. Thus, to make sure that the new CP value is used, at least one
instruction must be inserted between a CP-changing and a subsequent GPR-using
instruction, as shown in the following example:
I
n
I
n+1
I
n+2
: SCXT CP, #0FC00h
: ....
: MOV R0, #dataX
; select a new context
; must not be an instruction using a GPR
; write to GPR 0 in the new context
Data Page Pointer Updating
An instruction, which calculates a physical operand address via a particular DPPn (n=0
to 3) register, is mostly not capable of using a new DPPn register value, which is to be
updated by an immediately preceding instruction. Thus, to make sure that the new DPPn
register value is used, at least one instruction must be inserted between a DPPn-
changing instruction and a subsequent instruction which implicitly uses DPPn via a long
or indirect addressing mode, as shown in the following example:
I
n
I
n+1
I
n+2
: MOV DPP0, #4
: ....
: MOV DPP0:0000H, R1
; select data page 4 via DPP0
; must not be an instruction using DPP0
; move contents of R1 to address location 01
’
0000
H
; (in data page 4) supposed segmentation is enabled
Explicit Stack Pointer Updating
None of the RET, RETI, RETS, RETP or POP instructions is capable of correctly using
a new SP register value, which is to be updated by an immediately preceding instruction.
Thus, in order to use the new SP register value without erroneously performed stack
accesses, at least one instruction must be inserted between an explicitly SP-writing and
any subsequent of the just mentioned implicitly SP-using instructions, as shown in the
following example:
I
n
: MOV SP, #0FA40H
; select a new top of stack
相關PDF資料 |
PDF描述 |
|---|---|
| SAFC503 | 8-Bit CMOS Microcontroller |
| SAK-C164CI-8EM | 16-Bit Single-Chip Microcontroller |
| SAK-C164CL-6RM | 16-Bit Single-Chip Microcontroller |
| SAK-C164CL-8R25M | 16-Bit Single-Chip Microcontroller |
| SAK-C164CL-8RM | 16-Bit Single-Chip Microcontroller |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SAF-C165UTAH-LF V1.3 | 功能描述:16位微控制器 - MCU 16BIT SNGLChip MICRO CONTROLLER 3.3V RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風格:SMD/SMT |
| SAFC165UTAH-LF V1.3 | 制造商:Infineon Technologies AG 功能描述:MCU 16-bit C166 CISC/RISC ROMLess 3.3V 144-Pin TQFP |
| SAFC165UTAHLFV1.3 | 制造商:Lantiq 功能描述: |
| SAF-C165UTAH-LFV1.3 | 制造商:Lantiq 功能描述: |
| SAF-C165UTAH-LF-V1.3 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Infineon Technologies AG 功能描述: |
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