參數(shù)資料
型號： SAF82525N
廠商： INFINEON TECHNOLOGIES AG
英文描述： Data Communications ICs
中文描述： 數(shù)據(jù)通信集成電路
文件頁數(shù)： 121/126頁
文件大?。?/td> 730K
代理商： SAF82525N
Semiconductor Group
121
SAB 82525
SAB 82526
SAF 82525
SAF 82526
8
In case the DPLL detects an edge in the data stream in the range of DPLL count 5 to 10 (Phase
Shift) and this is the only one in the assumed bit cell period, then the DPLL receive clock phase
is shifted by a certain DPLL count value. The DPLL value and its corresponding phase shift in
degree is listed below for the HSCX versions VA3 and V2.1:
Clock Recovery (DPLL)
HSCX Version
DPLL Count
Phase Shift
VA3
8
180
°
V2.1
7
157.5
°
Differences
Ver. A3
Ver. 2.1
t
RD
t
RR
t
RI
t
XDD1 min
t
RTD1 min
t
RTD2 min
t
TCD min
100/110 ns
120 ns
60 ns
20 ns
30 ns
20 ns
20 ns
60/70 ns
70 ns
35 ns
10 ns
10 ns
10 ns
10 ns
相關(guān)PDF資料
PDF描述
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SAF82526N Data Communications ICs
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SAB82525H Data Communications ICs
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