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參數(shù)資料
| 型號(hào)： | SAF-C161O-LM HA |
| 廠商： | Infineon Technologies |
| 文件頁(yè)數(shù)： | 46/66頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 16BIT ROM/LESS MQFP-80-1 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | C16xx |
| 核心處理器： | C166 |
| 芯體尺寸： | 16-位 |
| 速度： | 20MHz |
| 連通性： | EBI/EMI，SPI，UART/USART |
| 外圍設(shè)備： | POR，PWM，WDT |
| 輸入/輸出數(shù)： | 63 |
| 程序存儲(chǔ)器類型： | ROMless |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 80-QFP |
| 包裝： | 剪切帶 (CT) |
| 其它名稱： | SAF-C161O-LMHACT SAF-C161O-LMHACT-ND SAF-C161O-LMHAINCT |
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C161K
C161O
Data Sheet
46
V2.0, 2001-01
Data valid to WrCS
t50 CC 28 + tC
–
2TCL - 22
+
tC
–
ns
Data hold after RdCS
t51 SR 0
–
0
–
ns
Data float after RdCS
t52 SR –
30 +
tF
–
2TCL - 20
+
tF
ns
Address hold after
RdCS, WrCS
t54 CC 30 + tF
–
2TCL - 20
+
tF
–
ns
Data hold after WrCS
t56 CC 30 + tF
–
2TCL - 20
+
tF
–
ns
1) These parameters refer to the latched chip select signals (CSxL). The early chip select signals (CSxE) are
specified together with the address and signal BHE (see figures below).
Multiplexed Bus (Reduced Supply Voltage Range) (cont’d)
(Operating Conditions apply)
ALE cycle time = 6 TCL + 2
tA + tC + tF (150 ns at 20 MHz CPU clock without waitstates)
Parameter
Symbol
Max. CPU Clock
= 20 MHz
Variable CPU Clock
1 / 2TCL = 1 to 20 MHz
Unit
min.
max.
min.
max.
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