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參數(shù)資料
| 型號： | SAA7326H |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | CABLE ASSEMBLY; TNC MALE TO TNC MALE; 75 OHM, RG59B/U COAX; 12" CABLE LENGTH; *USES STANDARD 50 OHM INTERFACE CONNECTORS* |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP64 |
| 封裝： | PLASTIC, SOT-393-1, QFP-64 |
| 文件頁數(shù)： | 58/68頁 |
| 文件大?。?/td> | 391K |
| 代理商： | SAA7326H |
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1999 Jun 17
58
Philips Semiconductors
Product specification
Digital servo processor and Compact Disc
decoder with integrated DAC (CD10)
SAA7326
Notes
1.
The 4-wire bus mode microcontroller interface timing for writing to decoder registers 0 to F, and reading Q-channel
subcode and decoder status, is a function of the overspeed factor ‘n’. In the lock-to-disc mode the maximum data
rate is lower.
Negative set-up time means that the data may change after clock transition.
If a 16.9344 MHz crystal is used and SELPLL = 0 then the timings are divided-by-2 until the microcontroller has
written X1XX to register B.
2.
3.
W
RITE MODE
(C
L
= 20 pF)
t
sD
set-up time SDA to SCL
t
hD
hold time SCL to SDA
t
sCL
set-up time SCL to SILD
t
hCL
hold time SILD to SCL
t
dPLP
delay between two SILD
pulses
t
dWZ
delay time SDA
high-impedance to SILD
0
950
480
120
70
0
950
480
120
70
ns
ns
ns
ns
μ
s
0
0
ns
SYMBOL
PARAMETER
CONDITIONS
NORMAL MODE
LOCK-TO-DISC MODE
UNIT
MIN.
MAX.
MIN.
MAX.
Fig.34 4-wire bus microcontroller timing; read mode (Q-channel subcode and decoder status information).
SDA (SAA7326)
high-impedance
SCL
RAB
tr
tr
0.8 V
tf
tf
VDD
0.8 V
VDD
0.8 V
0.8 V
VDD
0.8 V
0.8 V
tPD
tCL
tCH
tdRD
tdRZ
MGL707
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