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參數(shù)資料
| 型號： | SAA7326H |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | CABLE ASSEMBLY; TNC MALE TO TNC MALE; 75 OHM, RG59B/U COAX; 12" CABLE LENGTH; *USES STANDARD 50 OHM INTERFACE CONNECTORS* |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP64 |
| 封裝： | PLASTIC, SOT-393-1, QFP-64 |
| 文件頁數(shù)： | 54/68頁 |
| 文件大?。?/td> | 391K |
| 代理商： | SAA7326H |
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1999 Jun 17
54
Philips Semiconductors
Product specification
Digital servo processor and Compact Disc
decoder with integrated DAC (CD10)
SAA7326
10 OPERATING CHARACTERISTICS (SUBCODE INTERFACE TIMING)
V
DD
= 3.0 to 3.6 V; V
SS
= 0 V; T
amb
=
40 to +85
°
C; unless otherwise specified.
Note
1.
The subcode timing is directly related to the overspeed factor ‘n’ in normal operating mode. ‘n’ is replaced by the disc
speed factor ‘d’, in lock-to-disc mode.
SYMBOL
PARAMETER
MIN.
TYP.
MAX.
UNIT
Subcode interface timing (single-speed
×
n);
see Fig.32; note 1
I
NPUT
:
PIN
RCK
t
CLKH
t
CLKL
t
r
t
f
t
d(SFSY-RCK)
O
UTPUTS
:
PINS
SBSY, SFSY
AND
SUB (C
L
= 20 pF)
T
cy(block)
block cycle time
t
W(SBSY)
SBSY pulse width
T
cy(frame)
frame cycle time
t
W(SFSY)
SFSY pulse width (3-wire mode only)
t
SFSYH
SFSY HIGH time
t
SFSYL
SFSY LOW time
t
d(SFSY-SUB)
delay time SFSY to SUB (P data) valid
t
d(RCK-SUB)
delay time RCK falling to SUB
t
h(RCK-SUB)
hold time RCK to SUB
input clock HIGH time
input clock LOW time
input clock rise time
input clock fall time
delay time SFSY to RCK
2/n
2/n
10/n
4/n
4/n
6/n
6/n
80/n
80/n
20/n
μ
s
μ
s
ns
ns
μ
s
12.0/n
122/n
13.3/n
136/n
14.7/n
300/n
150/n
366/n
66/n
84/n
1/n
0
0.7/n
ms
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
μ
s
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