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參數(shù)資料
| 型號： | S9S12HA32J0CLL |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 76/796頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 16BIT 32KB FLASH 100LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | HCS12 |
| 核心處理器： | HCS12 |
| 芯體尺寸： | 16-位 |
| 速度： | 32MHz |
| 連通性： | EBI/EMI，I²C，IrDA，LIN，SCI，SPI |
| 外圍設(shè)備： | LCD，電機(jī)控制 PWM，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 80 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大?。?/td> | 4K x 8 |
| RAM 容量： | 2K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 727 (CN2011-ZH PDF) |
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Background Debug Module (S12SBDMV1)
Rev. 1.05
Freescale Semiconductor
167
NOTE
If an attempt is made to activate BDM before being enabled, the CPU
resumes normal instruction execution after a brief delay. If BDM is not
enabled, any hardware BACKGROUND commands issued are ignored by
the BDM and the CPU is not delayed.
In active BDM, the BDM registers and standard BDM rmware lookup table are mapped to addresses
0x3_FF00 to 0x3_FFFF. BDM registers are mapped to addresses 0x3_FF00 to 0x3_FF0B. The BDM uses
these registers which are readable anytime by the BDM. However, these registers are not readable by user
programs.
When BDM is activated while CPU executes code overlapping with BDM rmware space the saved
program counter (PC) will be auto incremented by one from the BDM rmware, no matter what caused
the entry into BDM active mode (BGND instruction, BACKGROUND command or breakpoints). In such
a case the PC must be set to the next valid address via a WRITE_PC command before executing the GO
command.
5.4.3
BDM Hardware Commands
Hardware commands are used to read and write target system memory locations and to enter active
background debug mode. Target system memory includes all memory that is accessible by the CPU such
as on-chip RAM, Flash, I/O and control registers.
Hardware commands are executed with minimal or no CPU intervention and do not require the system to
be in active BDM for execution, although, they can still be executed in this mode. When executing a
hardware command, the BDM sub-block waits for a free bus cycle so that the background access does not
disturb the running application program. If a free cycle is not found within 128 clock cycles, the CPU is
momentarily frozen so that the BDM can steal a cycle. When the BDM nds a free cycle, the operation
does not intrude on normal CPU operation provided that it can be completed in a single cycle. However,
if an operation requires multiple cycles the CPU is frozen until the operation is complete, even though the
BDM found a free cycle.
The BDM hardware commands are listed in Table 5-5.
are not normally in the system memory map but share addresses with the application in memory. To
distinguish between physical memory locations that share the same address, BDM memory resources are
locations unobtrusively, even if the addresses conict with the application memory map.
Table 5-5. Hardware Commands
Command
Opcode
(hex)
Data
Description
BACKGROUND
90
None
Enter background mode if BDM is enabled. If enabled, an ACK will be issued
when the part enters active background mode.
ACK_ENABLE
D5
None
Enable Handshake. Issues an ACK pulse after the command is executed.
ACK_DISABLE
D6
None
Disable Handshake. This command does not issue an ACK pulse.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| S9S12HY48J0CLL | IC MCU 16BIT 48KB FLASH 100LQFP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| S9S12HA48J0CLL | 功能描述:16位微控制器 - MCU 16BIT 48K FL 4K RAM RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT |
| S9S12HN64J3VAA | 制造商:Freescale Semiconductor 功能描述:MCU 16BIT HCS12 CISC 64KB FLASH 2.5V/5V 80PQFP - Trays |
| S9S12HN64J3VAL | 制造商:Freescale Semiconductor 功能描述:MCU 16BIT HCS12 CISC 64KB FLASH 2.5V/5V 112LQFP - Trays |
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