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參數(shù)資料
| 型號： | S5N8950 |
| 廠商： | SAMSUNG SEMICONDUCTOR CO. LTD. |
| 英文描述： | G.dmt ADSL Transceiver for CO and CPE |
| 中文描述： | G.dmt寬帶收發(fā)器對CO和CPE |
| 文件頁數(shù)： | 14/19頁 |
| 文件大?。?/td> | 203K |
| 代理商： | S5N8950 |
S5N8950
G.dmt ADSL Transceiver for CO and CPE
CONFIDENTIAL
Preliminary Information ( Rev 1.2 )
5.4 Motorola Write Cycle Timing Information
Figure 7: Motorola write cycle timing diagram.
Parameter
t
1
t
2
t
3
t
4
t
5
Description
Min
0
0
Max
Unit
§ à
§ à
§ à
§ à
§ à
H_ADDR setup to H_CSN
↓
H_WRN
↓
before H_CSN
↓
H_DATA valid from H_READY
↓
H_READY hi-Z from H_CSN
↑
H_DATA hold after H_CSN
↑
50
5
1
5
Table 7: Motorola write cycle timing table.
5.5 Intel Read Cycle Timing Information
Figure 8: Intel read cycle timing diagram.
H_DATA[15:0]
H_ADDR[9:0]
H_CSN
H_WRN
H_READY
t
1
t
2
t
5
t
4
VALID
(DTACKN)
t
3
H_DATA[15:0]
H_ADDR[9:0]
H_CSN
H_RDN
H_READY
t
1
t
3
t
6
VALID
t
2
t
4
t
5
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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