參數(shù)資料
型號(hào)： S3P7559-AT
元件分類： 微控制器/微處理器
英文描述： 4-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PDIP64
封裝： 0.750 INCH, SDIP-64
文件頁(yè)數(shù)： 53/197頁(yè)
文件大小： 1181K
代理商： S3P7559-AT
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S3C7559/P7559
TIMERS and TIMER/COUNTERS
11-17
TC MODE REGISTER (TMODn)
TMODn are the 8-bit mode control registers for timer/counter 0 and 1. They are addressable by 8-bit write
instructions. One bit, TMODn.3, is also 1-bit writeable.
RESET clears all TMODn bits to logic zero and disables
TC operations.
F90H
TMOD0.3
TMOD0.2
"0"
TMOD0
F91H
"0"
TMOD0.6
TMOD0.5
TMOD0.4
FA0H
TMOD1.3
TMOD1.2
"0"
TMOD1
FA1H
"0"
TMOD1.6
TMOD1.5
TMOD1.4
TMODn.2 is the enable/disable bit for timer/counter 0 and 1. When TMODn.3 is set to "1", the contents of
TCNTn, IRQTn, and TOLn are cleared, counting starts from 00H, and TMODn.3 is automatically reset to "0" for
normal TC operation. When TC operation stops (TMODn.2 = "0"), the contents of the counter register TCNTn are
retained until TC is re-enabled.
The TMODn.6, TMODn.5, and TMODn.4 bit settings are used together to select the TC clock source. This
selection involves two variables:
— Synchronization of timer/counter operations with either the rising edge or the falling edge of the clock signal
input at the TCLn pin, and
— Selection of one of four frequencies, based on division of the incoming system clock frequency, for use in
internal TC operation.
Table 11-6. TC Mode Register (TMODn) Organization
Bit Name
Setting
Resulting TC0 Function
Address
TMODn.7
0
Always logic zero
F91H (TMOD0)
TMODn.6
0,1
Specify input clock edge and internal frequency
FA1H (TMOD1)
TMODn.5
TMODn.4
TMODn.3
1
Clear TCNTn, IRQTn, and TOLn and resume counting
immediately (This bit is automatically cleared to logic zero
immediately after counting resumes.)
F90H (TMOD0)
FA0H (TMOD1)
TMODn.2
0
Disable timer/counter; retain TCNTn contents
1
Enable timer/counter
TMODn.1
0
Always logic zero
TMODn.0
0
Always logic zero
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