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參數(shù)資料
| 型號(hào)： | S3P7434-QZ |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PQFP44 |
| 封裝： | 10 X 10 MM, QFP-44 |
| 文件頁數(shù)： | 38/216頁 |
| 文件大?。?/td> | 1368K |
| 代理商： | S3P7434-QZ |
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TIMERS and TIMER/COUNTER
S3C7414/P7414/C7424/P7424/C7434/P7434
11-4
BASIC TIMER MODE REGISTER (BMOD)
The basic timer mode register, BMOD, is a 4-bit write-only register located at RAM address F85H. Bit 3, the
basic timer start control bit, is also 1-bit addressable. All BMOD values are set to logic zero following RESET and
interrupt request signal generation is set to the longest interval. (BT counter operation cannot be stopped.)
BMOD settings have the following effects:
— Restart the basic timer,
— Control the frequency of clock signal input to the basic timer, and
— Determine time interval required for clock oscillation to stabilize following the release of stop modes by an
interrupt.
By loading different values into the BMOD register, you can dynamically modify the basic timer clock frequency
during program execution. Four BT frequencies, ranging from fx/212 (1.02 kHz) to fx/25 (131 kHz), are selectable.
Since BMOD's reset value is logic zero, the default clock frequency setting is fx/212. (kHz frequencies assume a
system clock (fx) frequency of 4.19 MHz.)
The most significant bit of the BMOD register, BMOD.3, is used to start the basic timer again. When BMOD.3 is
set to logic one (enabled) by a 1-bit write instruction, the contents of the BT counter register (BCNT) and the BT
interrupt request flag (IRQB) are both cleared to logic zero, and timer operation is restarted.
The combination of bit settings in the remaining three registers — BMOD.2, BMOD.1, and BMOD.0 — determine
the clock input frequency and oscillation stabilization interval.
Table 11-2. Basic Timer Mode Register (BMOD) Organization
BMOD.3
Basic Timer Enable/Disable Control Bit
1
Start basic timer; clear IRQB, BCNT, and BMOD.3 to "0"
BMOD.2
BMOD.1
BMOD.0
Basic Timer Input Clock
Oscillation Stabilization
0
fx/212 (1.02 kHz)
220/fx (250 ms)
0
1
fx/29 (8.18 kHz)
217/fx (31.3 ms)
1
0
1
fx/27 (32.7 kHz)
215/fx (7.82 ms)
1
fx/25 (131 kHz)
213/fx (1.95 ms)
NOTES:
1.
Clock frequencies and stabilization intervals assume a system oscillator clock frequency (fx) of 4.19 MHz.
2.
fx = system clock frequency.
3.
Oscillation stabilization time is the time required to stabilize clock signal oscillation after stop mode is released.
4.
The standard stabilization time for system clock oscillation following a RESET is 31.3 ms at 4.19 MHz.
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