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參數(shù)資料
| 型號： | S1D15E06D03B000 |
| 廠商： | 愛普生（中國）有限公司 |
| 英文描述： | Direct RAM data display by display data RAM |
| 中文描述： | RAM數(shù)據(jù)顯示直接由顯示數(shù)據(jù)RAM |
| 文件頁數(shù)： | 33/74頁 |
| 文件大小： | 490K |
| 代理商： | S1D15E06D03B000 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁當前第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁
S1D15E06 Series
30
EPSON
Rev. 2.1
(7) Page Address Set
This command specifies the page address corresponding to row address when MPU access to the display data RAM
shown in Fig. 6.5 and 6.6. For details, see the description of “6.2.2 Page address circuit” in the Function Description.
E
R/W
WR
0
0
A0
0
1
RD
1
1
D7
1
*
D6
0
*
D5
1
P5
D4
1
P4
D3
0
P3
D2
0
P2
D1
0
P1
D0
1
P0
Page address
Command
Page address setting
*: denote invalid bits.
P5
0
0
P4
0
0
P3
0
0
P2
0
0
P1
0
0
P0
0
1
Page address
0
1
↓
31
32
↓
1
0
0
1
1
0
1
0
1
0
1
0
(8) Column Address Set
This command sets the display data RAM column address given in Fig. 6.5 and 6.6. For details, see the description of
“6.2.3 Column address circuit” in the Function Description.
E
R/W
WR
0
0
A0
0
1
RD
1
1
D7
0
P7
D6
0
P6
D5
0
P5
D4
1
P4
D3
0
P3
D2
0
P2
D1
1
P1
D0
1
P0
Column
address
0
1
2
↓
158
159
P7
0
0
0
P6
0
0
0
P5
0
0
0
P4
0
0
0
P3
0
0
0
P2
0
0
0
P1
0
0
1
P0
0
1
0
↓
1
1
0
0
0
0
0
1
0
1
0
1
1
1
0
1
(9) Display Data Write
This command allows the 8-bit data to be written to the address specified by the display data RAM. After writing,
column address or page address is automatically incremented +1 by the Display Data Input Direction Select command.
This enables the MPU to write the display data continuously.
E
R/W
WR
0
0
A0
0
1
RD
1
1
D7
0
D6
0
D5
0
D4
1
Write Data
D3
1
D2
1
D1
0
D0
1
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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