參數(shù)資料
型號： S1D13505F00A
廠商： 愛普生（中國）有限公司
英文描述： S1D13505 Embedded RANMAC LCD/CRT Controller
中文描述： 嵌入式RANMAC液晶顯示器/ CRT控制器S1D13505
文件頁數(shù)： 507/565頁
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代理商： S1D13505F00A
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Page 20
Epson Research and Development
Vancouver Design Center
S1D13505
X23A-G-008-05
Interfacing to the Motorola MPC821 Microprocessor
Issue Date: 01/02/05
4.6 Test Software
The test software is very simple. It configures chip select 4 (CS4) on the MPC821 to map
the S1D13505 to an unused 4M byte block of address space. Next, it loads the appropriate
values into the option register for CS4 and writes the value 0 to the S1D13505 register
REG[1Bh] to enable the S1D13505 host interface. Lastly, the software runs a tight loop that
reads the S1D13505 Revision Code Register REG[00h]. This allows monitoring of the bus
timing on a logic analyzer.
The following source code was entered into the memory of the MPC821ADS using the
line-by-line assembler in MPC8BUG (the debugger provided with the ADS board). Once
the program was executed on the ADS, a logic analyzer was used to verify operation of the
interface hardware.
It is important to note that when the MPC821 comes out of reset, the on-chip caches and
MMU are disabled. If the data cache is enabled, then the MMU must be set so that the
S1D13505 memory block is tagged as non-cacheable. This ensures the MPC821 does not
attempt to cache any data read from, or written to, the S1D13505 or its display buffer.
BR4
OR4
MemStart
DisableReg
RevCodeReg
equ
equ
equ
equ
equ
$120
$124
$40
$1b
0
; CS4 base register
; CS4 option register
; upper word of S1D13505 start address
; address of S1D13505 Disable Register
; address of Revision Code Register
Start
mfspr
andis.
andis.
oris
ori
stw
andis.
oris
ori
r1,IMMR
r1,r1,$ffff
r2,r0,0
r2,r2,MemStart
r2,r2,$0801
r2,BR4(r1)
r2,r0,0
r2,r2,$ffc0
r2,r2,$0608
; get base address of internal registers
; clear lower 16 bits to 0
; clear r2
; write base address
; port size 16 bits; select GPCM; enable
; write value to base register
; clear r2
; address mask – use upper 10 bits
; normal CS negation; delay CS clock;
; no burst inhibit (13505 does this)
; write to option register
; clear r1
; point r1 to start of S1D13505 mem space
r1,DisableReg(r1) ; write 0 to disable register
r0,RevCodeReg(r1) ; read revision code into r1
Loop
; branch forever
stw
andis.
oris
stb
lbz
b
r2,OR4(r1)
r1,r0,0
r1,r1,MemStart
Loop
end
Note
MPC8BUG does not support comments or symbolic equates; these have been added for
clarity.
相關PDF資料
PDF描述
S1D13506 S1D13506 Color LCD/CRT/TV Controller
S1D13700 Embedded Memory Graphics LCD Controller
S1D13706 S1D13706 Embedded Memory LCD Controller
S1D15E06 Direct RAM data display by display data RAM
S1D15E06D01B000 Direct RAM data display by display data RAM
相關代理商/技術參數(shù)
參數(shù)描述
S1D13505F00A100 制造商:Epson Electronics America Inc 功能描述:LCD Controller, Embedded RAMDAC, 64K colors
S1D13505F00A200 功能描述:LCD 驅動器 LCD Controllers RoHS:否 制造商:Maxim Integrated 數(shù)位數(shù)量:4.5 片段數(shù)量:30 最大時鐘頻率:19 KHz 工作電源電壓:3 V to 3.6 V 最大工作溫度:+ 85 C 最小工作溫度:- 20 C 封裝 / 箱體:PDIP-40 封裝:Tube
S1D13506 制造商:EPSON 制造商全稱:EPSON 功能描述:S1D13506 Color LCD/CRT/TV Controller
S1D13506F00A 制造商:EPSON 制造商全稱:EPSON 功能描述:LCD Controller ICs
S1D13506F00A100 制造商:Epson Electronics America Inc 功能描述:LCD DRVR 3V/3.3V/5V 80-Pin TQFP
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