參數(shù)資料
型號(hào)： S1D13505F00A
廠商： 愛(ài)普生（中國(guó)）有限公司
英文描述： S1D13505 Embedded RANMAC LCD/CRT Controller
中文描述： 嵌入式RANMAC液晶顯示器/ CRT控制器S1D13505
文件頁(yè)數(shù)： 262/565頁(yè)
文件大?。?/td> 4736K
代理商： S1D13505F00A
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S1D13505F00A Register Summary
X23A-R-001-04
Page 1
01/02/06
Notes
1
These bits are used to identify the S1D13505. For the S1D13505 the product code should be 3. The host
2
N/A bits should be written 0.
REG[00h] R
EVISION
C
ODE
R
EGISTER
1
(For S1D13505: Product Code=000011b, Revision Code=00b)
RO
Product Code
Bit 5
Bit 4
Bit 3
Bit 2
Revision Code
Bit 1
Bit 1
Bit 0
Bit 0
REG[01h] M
EMORY
C
ONFIGURATION
R
EGISTER
1/0
RW
n/a
2
Refresh Rate
3
Bit 1
n/a
WE# Control
n/a
Type
Bit 2
Bit 0
REG[02h] P
ANEL
T
YPE
R
EGISTER
Enable
1/0
RW
n/a
Panel Data Width
4
Bit 1
Panel Data
Panel Slct
Panel Slct
TFT/Passive
Bit 0
REG[03h] M
OD
R
ATE
R
EGISTER
RW
n/a
n/a
MOD Rate
Bit 3
Bit 5
Bit 4
Bit 2
Bit 1
Bit 0
REG[04h] H
ORIZONTAL
D
ISPLAY
W
IDTH
R
EGISTER
RW
n/a
Horizontal Display Width = 8(REG + 1)
Bit 4
Bit 3
Bit 6
Bit 5
Bit 2
Bit 1
Bit 0
REG[05h] H
ORIZONTAL
N
ON
-D
ISPLAY
P
ERIOD
R
EGISTER
RW
n/a
n/a
n/a
Horizontal Non-Display Period = 8(REG + 1)
Bit 3
Bit 2
Bit 4
Bit 1
Bit 0
REG[06h] HRTC/FPLINE S
TART
P
OSITION
R
EGISTER
RW
n/a
n/a
n/a
HRTC/FPLINE Start Position = 8(REG + 1) - 2
Bit 3
Bit 2
Bit 4
Bit 1
Bit 0
REG[07h] HRTC/FPLINE P
ULSE
W
IDTH
R
EGISTER
RW
Po HRTC
PFPLINE
n/a
n/a
HRTC/FPLINE Pulse Width = 8(REG + 1)
Bit 3
Bit 2
Bit 1
Bit 0
REG[08h] V
ERTICAL
D
ISPLAY
H
EIGHT
R
EGISTER
0
RW
Vertical Display Height = (REG + 1)
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[09h] V
ERTICAL
D
ISPLAY
H
EIGHT
R
EGISTER
1
RW
n/a
n/a
n/a
n/a
n/a
n/a
Vertical Display Height
Bit 9
Bit 8
REG[0Ah] V
ERTICAL
N
ON
-D
ISPLAY
P
ERIOD
R
EGISTER
RW
StVNDP
n/a
Vertical Non-Display Period (VNDP) = (REG + 1)
Bit 4
Bit 3
Bit 5
Bit 2
Bit 1
Bit 0
REG[0Bh] VRTC/FPFRAME S
TART
P
OSITION
R
EGISTER
RW
n/a
n/a
VRTC/FPFRAME Start Position = (REG + 1)
Bit 4
Bit 3
Bit 5
Bit 2
Bit 1
Bit 0
REG[0Ch] VRTC/FPFRAME P
ULSE
W
IDTH
R
EGISTER
RW
PoVRTC
FPFRAME
n/a
n/a
n/a
VRTC/FPFRAME Pulse Width = (REG + 1)
Bit 2
Bit 1
Bit 0
REG[0Dh] D
ISPLAY
M
ODE
R
EGISTER
Portrait
Mode
Bit 1
RW
SimOption Select
5
Bit-per-pixel Select
6
CRT Enable LCD Enable
Bit 0
Bit 2
Bit 1
Bit 0
REG[0Eh] S
CREEN
1 L
INE
C
OMPARE
R
EGISTER
0
RW
Screen 1 Line Compare
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[0Fh] S
CREEN
1 L
INE
C
OMPARE
R
EGISTER
1
RW
n/a
n/a
n/a
n/a
n/a
n/a
Screen 1 Line Compare
Bit 9
Bit 8
REG[10h] S
CREEN
1 D
ISPLAY
S
TART
A
DDRESS
R
EGISTER
0
RW
Screen 1 Start Address
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[11h] S
CREEN
1 D
ISPLAY
S
TART
A
DDRESS
R
EGISTER
1
RW
Screen 1 Start Address
Bit 12
Bit 15
Bit 14
Bit 13
Bit 11
Bit 10
Bit 9
Bit 8
REG[12h] S
CREEN
1 D
ISPLAY
S
TART
A
DDRESS
R
EGISTER
2
RW
n/a
n/a
n/a
n/a
Screen 1 Start Address
Bit 18
Bit 19
Bit 17
Bit 16
REG[13h] S
CREEN
2 D
ISPLAY
S
TART
A
DDRESS
R
EGISTER
0
RW
Screen 2 Start Address
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[14h] S
CREEN
2 D
ISPLAY
S
TART
A
DDRESS
R
EGISTER
1
RW
Screen 2 Start Address
Bit 12
Bit 15
Bit 14
Bit 13
Bit 11
Bit 10
Bit 9
Bit 8
REG[15h] S
CREEN
2 D
ISPLAY
S
TART
A
DDRESS
R
EGISTER
2
RW
n/a
n/a
n/a
n/a
Screen 2 Start Address
Bit 18
Bit 19
Bit 17
Bit 16
REG[16h] M
EMORY
A
DDRESS
O
FFSET
R
EGISTER
0
RW
Memory Address Offset
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[17h] M
EMORY
A
DDRESS
O
FFSET
R
EGISTER
1
RW
n/a
n/a
n/a
n/a
n/a
Memory Address Offset
Bit 10
Bit 9
Bit 8
REG[18h] P
IXEL
P
ANNING
R
EGISTER
Screen 2 Pixel Panning
Bit 3
Bit 2
RW
Screen 1 Pixel Panning
Bit 2
Bit 1
Bit 0
Bit 3
Bit 1
Bit 0
REG[19h] C
LOCK
C
ONFIGURATION
R
EGISTER
RW
Reserved
n/a
n/a
n/a
n/a
DiMCLK
PCLK Divide
7
Slct
Bit 1
Bit 0
REG[1Ah] P
OWER
S
AVE
C
ONFIGURATION
R
EGISTER
RW
Status RO
n/a
n/a
n/a
LDisable
Suspend Refresh Select
8
Bit 1
SSoftware
Bit 0
REG[1Bh] M
ISCELLANIOUS
R
EGISTER
IDisable
RW
n/a
n/a
n/a
n/a
n/a
n/a
HBuffer
Disable
REG[1Ch] MD C
ONFIGURATION
R
EADBACK
R
EGISTER
0
MD7
MD6
RO
MD5
MD4
MD3
MD2
MD1
MD0
REG[1Dh] MD C
ONFIGURATION
R
EADBACK
R
EGISTER
1
MD15
MD14
RO
MD13
MD12
MD11
MD10
MD9
MD8
REG[1Eh] G
ENERAL
IO P
INS
C
ONFIGURATION
R
EGISTER
0
RW
n/a
n/a
n/a
n/a
IO Config
IO Config
IO Config
n/a
REG[1Fh] G
ENERAL
IO P
INS
C
ONFIGURATION
R
EGISTER
1
RW
n/a
n/a
n/a
n/a
n/a
n/a
n/a
n/a
REG[20h] G
ENERAL
IO P
INS
C
ONTROL
R
EGISTER
0
RW
n/a
n/a
n/a
n/a
IO Status
IO Status
IO Status
n/a
REG[21h] G
ENERAL
IO P
INS
C
ONTROL
R
EGISTER
1
GPO
RW
n/a
n/a
n/a
n/a
n/a
n/a
n/a
REG[22h] P
ERFORMANCE
E
NHANCEMENT
R
EGISTER
0
RC Timing Value
9
RW
Reserved
RCAS#
Delay
10
RAS# Precharge
11
Timing
Reserved
Reserved
Bit 1
Bit 0
Bit 1
Bit 0
REG[23h] P
ERFORMANCE
E
NHANCEMENT
R
EGISTER
1
CPU to Memory Wait State
Bit 1
RW
DiDisable
Display FIFO Threshold
Bit 3
Bit 2
Bit 0
Bit 4
Bit 1
Bit 0
REG[24h] L
OOK
-U
P
T
ABLE
A
DDRESS
R
EGISTER
RW
Look-Up Table Address
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[26h] L
OOK
-U
P
T
ABLE
D
ATA
R
EGISTER
Look-Up Table Data
Bit 3
Bit 2
RW
n/a
n/a
n/a
n/a
Bit 1
Bit 0
REG[27h] I
NK
/C
URSOR
C
ONTROL
R
EGISTER
Ink/Cursor Mode
Bit 1
Bit 0
RW
n/a
n/a
Cursor High Threshold
Bit 2
Bit 3
Bit 1
Bit 0
REG[28h] C
URSOR
X P
OSITION
R
EGISTER
0
RW
Cursor X Position
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[29h] C
URSOR
X P
OSITION
R
EGISTER
1
RW
Reserved
n/a
n/a
n/a
n/a
n/a
Cursor X Position
Bit 9
Bit 8
REG[2Ah] C
URSOR
Y P
OSITION
R
EGISTER
0
RW
Cursor Y Position
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[2Bh] C
URSOR
Y P
OSITION
R
EGISTER
1
RW
Reserved
n/a
n/a
n/a
n/a
n/a
Cursor Y Position
Bit 9
Bit 8
REG[2Ch] I
NK
/C
URSOR
C
OLOR
0 R
EGISTER
0
RW
Cursor Color 0
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[2Dh] I
NK
/C
URSOR
C
OLOR
0 R
EGISTER
1
RW
Cursor Color 0
Bit 12
Bit 15
Bit 14
Bit 13
Bit 11
Bit 10
Bit 9
Bit 8
REG[2Eh] I
NK
/C
URSOR
C
OLOR
1 R
EGISTER
0
RW
Cursor Color 1
Bit 4
Bit 7
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[2Fh] I
NK
/C
URSOR
C
OLOR
1 R
EGISTER
1
RW
Cursor Color 1
Bit 12
Bit 15
Bit 14
Bit 13
Bit 11
Bit 10
Bit 9
Bit 8
REG[30h] I
NK
/C
URSOR
S
TART
A
DDRESS
S
ELECT
R
EGISTER
RW
Ink/Cursor Start Address Select
12
Bit 4
Bit 7 WO
Bit 6
Bit 5
Bit 3
Bit 2
Bit 1
Bit 0
REG[31h] A
LTERNATE
FRM R
EGISTER
RW
Alternate Frame Range Modulation Select
Bit 5
Bit 4
Bit 7
Bit 6
Bit 3
Bit 2
Bit 1
Bit 0
相關(guān)PDF資料
PDF描述
S1D13506 S1D13506 Color LCD/CRT/TV Controller
S1D13700 Embedded Memory Graphics LCD Controller
S1D13706 S1D13706 Embedded Memory LCD Controller
S1D15E06 Direct RAM data display by display data RAM
S1D15E06D01B000 Direct RAM data display by display data RAM
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
S1D13505F00A100 制造商:Epson Electronics America Inc 功能描述:LCD Controller, Embedded RAMDAC, 64K colors
S1D13505F00A200 功能描述:LCD 驅(qū)動(dòng)器 LCD Controllers RoHS:否 制造商:Maxim Integrated 數(shù)位數(shù)量:4.5 片段數(shù)量:30 最大時(shí)鐘頻率:19 KHz 工作電源電壓:3 V to 3.6 V 最大工作溫度:+ 85 C 最小工作溫度:- 20 C 封裝 / 箱體:PDIP-40 封裝:Tube
S1D13506 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:S1D13506 Color LCD/CRT/TV Controller
S1D13506F00A 制造商:EPSON 制造商全稱(chēng):EPSON 功能描述:LCD Controller ICs
S1D13506F00A100 制造商:Epson Electronics America Inc 功能描述:LCD DRVR 3V/3.3V/5V 80-Pin TQFP
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