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參數(shù)資料
| 型號： | S1C33222F01E |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 60 MHz, RISC MICROCONTROLLER, PQFP128 |
| 封裝： | PLASTIC, QFP5-128 |
| 文件頁數(shù)： | 124/512頁 |
| 文件大小： | 3090K |
| 代理商： | S1C33222F01E |
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1
OUTLINE
A-8
EPSON
S1C33209/221/222 PRODUCT PART
Table 1.3.3
List of Pins for HSDMA Control Signals
Pin name
Pin No.
I/O
Pull-up
Function
QFP5-128
QFP15-128
K50
#DMAREQ0
34
31
I
Pull-up K50:
Input port when CFK50(D0/0x402C0) = "0" (default)
#DMAREQ0: HSDMA Ch. 0 request input when CFK50(D0/0x402C0) = "1"
K51
#DMAREQ1
26
23
I
Pull-up K51:
Input port when CFK51(D1/0x402C0) = "0" (default)
#DMAREQ1: HSDMA Ch. 1 request input when CFK51(D1/0x402C0) = "1"
K53
#DMAREQ2
22
19
I
Pull-up K53:
Input port when CFK53(D3/0x402C0) = "0" (default)
#DMAREQ2: HSDMA Ch. 2 request input when CFK53(D3/0x402C0) = "1"
K54
#DMAREQ3
20
17
I
Pull-up K54:
Input port when CFK54(D4/0x402C0) = "0" (default)
#DMAREQ3: HSDMA Ch. 3 request input when CFK54(D4/0x402C0) = "1"
P32
#DMAACK0
#SRDY3
16
13
I/O
–
P32:
I/O port when CFP32(D2/0x402DC) = "0" (default)
#DMAACK0: HSDMA Ch. 0 acknowledge output when CFP32(D2/0x402DC)=
"1"
#SRDY3:
Serial I/F Ch.3 ready signal input/output when SSRDY3
(D3/0x402D7) = "1" and CFP32(D2/0x402DC) = "0"
P33
#DMAACK1
SIN3
18
15
I/O
–
P33:
I/O port when CFP33(D3/0x402DC) = "0" (default)
#DMAACK1: HSDMA Ch. 1 acknowledge output when CFP33(D3/0x402DC)=
"1"
SIN3:
Serial I/F Ch. 3 data input when SSIN3(D0/0x402D7) = "1" and
CFP33(D3/0x402DC) = "0"
P04
SIN1
#DMAACK2
102
99
I/O
–
P04:
I/O port when CFP04(D4/0x402D0) = "0" and
CFEX4(D4/0x402DF) = "0" (default)
SIN1:
Serial I/F Ch. 1 data input when CFP04(D4/0x402D0) = "1" and
CFEX4(D4/0x402DF) = "0"
#DMAACK2: HSDMA Ch. 2 acknowledge outputwhen CFEX4(D4/0x402DF) =
"1"
P06
#SCLK1
#DMAACK3
104
101
I/O
–
P06:
I/O port when CFP06(D6/0x402D0) = "0" and
CFEX6(D6/0x402DF) = "0" (default)
#SCLK1:
Serial I/F Ch. 1 clock input/output when CFP06(D6/0x402D0) =
"1" and CFEX6(D6/0x402DF) = "0"
#DMAACK3: HSDMA Ch. 3 acknowledge outputwhen CFEX6(D6/0x402DF)=
"1"
P15
EXCL4
#DMAEND0
#SCLK3
5
2
I/O
–
P15:
I/O port when CFP15(D5/0x402D4) = "0" (default)
EXCL4:
16-bit timer 4 event counter input when CFP15(D5/0x402D4) = "1"
and IOC15(D5/0x402D6) = "0"
#DMAEND0: HSDMA Ch. 0 end-of-transfer signal output when
CFP15(D5/0x402D4) = "1" and IOC15(D5/0x402D6) = "1"
#SCLK3:
Serial I/F Ch.3 clock input/output when SSCLK3(D2/0x402D7) =
"1" and CFP15(D5/0x402D4) = "0"
P16
EXCL5
#DMAEND1
SOUT3
84
81
I/O
–
P16:
I/O port when CFP16(D6/0x402D4) = "0" (default)
EXCL5:
16-bit timer 5 event counter input when CFP16(D6/0x402D4) = "1"
and IOC16(D6/0x402D6) = "0"
#DMAEND1: HSDMA Ch. 1 end-of-transfer signal output when
CFP16(D6/0x402D4) = "1" and IOC16(D6/0x402D6) = "1"
SOUT3:
Serial I/F Ch.3 data outputwhen SSOUT3(D1/0x402D7)= "1" and
CFP16(D6/0x402D4) = "0"
P05
SOUT1
#DMAEND2
103
100
I/O
–
P05:
I/O port when CFP05(D5/0x402D0) = "0" and
CFEX5(D5/0x402DF) = "0" (default)
SOUT1:
Serial I/F Ch. 1 data output when CFP05(D5/0x402D0) = "1" and
CFEX5(D5/0x402DF) = "0"
#DMAEND2: HSDMA Ch. 2 end-of-transfer signal output when
CFEX5(D5/0x402DF) = "1"
P07
#SRDY1
#DMAEND3
110
107
I/O
–
P07:
I/O port when CFP07(D7/0x402D0) = "0" and
CFEX7(D7/0x402DF) = "0" (default)
#SRDY1:
Serial I/F Ch. 1 ready signal input/output when
CFP07(D7/0x402D0) = "1" and CFEX5(D5/0x402DF) = "0"
#DMAEND3: HSDMA Ch. 3 end-of-transfer signal output when
CFEX7(D7/0x402DF) = "1"
相關(guān)PDF資料 |
PDF描述 |
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