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參數(shù)資料
| 型號： | S-35399A03-J8T2U |
| 元件分類： | 時鐘/數(shù)據(jù)恢復(fù)及定時提取 |
| 英文描述： | 1 TIMER(S), REAL TIME CLOCK, PDSO8 |
| 封裝： | HALOGEN FREE AND LEAD FREE, SOP-8 |
| 文件頁數(shù)： | 51/53頁 |
| 文件大?。?/td> | 472K |
| 代理商： | S-35399A03-J8T2U |
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2-WIRE REAL-TIME CLOCK
Rev.2.0_00
S-35399A03
Seiko Instruments Inc.
7
AC Electrical Characteristics
Table 7 Measurement Conditions
Input pulse voltage
VIH = 0.8 × VDD, VIL = 0.2 × VDD
Input pulse rise/fall time
20 ns
Output determination voltage
VOH = 0.5 × VDD, VOL = 0.5 × VDD
Output load
100 pF
+ pull-up resistor 1 kΩ
SDA
C = 100 pF
VDD
R = 1 k
Ω
Remark
The power supplies of the IC
and load have the same
electrical potential.
Figure 6 Output Load Circuit
Table 8 AC Electrical Characteristics
(Ta =
40 to +85°C)
VDD
*2 ≥ 1.3 V
VDD
*2 ≥ 3.0 V
Parameter
Symbol
Min.
Typ.
Max.
Min.
Typ.
Max.
Unit
SCL clock frequency
fSCL
0
100
0
400
kHz
SCL clock low time
tLOW
4.7
1.3
μs
SCL clock high time
tHIGH
4
0.6
μs
SDA output delay time
*1
tPD
3.5
0.9
μs
Start condition setup time
tSU.STA
4.7
0.6
μs
Start condition hold time
tHD.STA
4
0.6
μs
Data input setup time
tSU.DAT
250
100
ns
Data input hold time
tHD.DAT
0
0
μs
Stop condition setup time
tSU.STO
4.7
0.6
μs
SCL, SDA rise time
tR
1
0.3
μs
SCL, SDA fall time
tF
0.3
0.3
μs
Bus release time
tBUF
4.7
1.3
μs
Noise suppression time
tI
100
50
ns
*1.
Since the output format of the SDA pin is Nch open-drain output, SDA output delay time is determined by the values of
the load resistance (RL) and load capacity (CL) outside the IC. Therefore, use this value only as a reference value.
*2.
Regarding the power supply voltage, refer to “ Recommended Operation Conditions”.
SCL
SDA
(Input from
S-35399A03)
SDA
(Output from
S-35399A03)
tBUF
tR
tSU.STO
tSU.DAT
tHD.DAT
tPD
tHIGH
tLOW
tHD.STA
tSU.STA
tF
Figure 7 Bus Timing
相關(guān)PDF資料 |
PDF描述 |
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