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參數(shù)資料
| 型號： | RD3152MMA7260Q |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 19/232頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD REF 3-AXIS ACCELEROMETER |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | ZSTAR |
| 傳感器類型： | 加速計，3 軸 |
| 傳感范圍： | ±1.5g，2g，4g，6g |
| 接口： | 模擬 |
| 靈敏度： | 800、600、300 或 200 mV/g |
| 電源電壓： | 2.2 V ~ 3.6 V |
| 嵌入式： | 是，MCU，8 位 |
| 已供物品： | 2 個板，電池，CD |
| 已用 IC / 零件： | MMA7260，MC68HC908JW32 |
| 相關(guān)產(chǎn)品： | MMA6281QR2CT-ND - IC ACCELEROMETER XZ AXIS 16-QFN MMA7261QR2CT-ND - SENSOR ACCEL 3-AXIS +/-2.5 16QFN MMA6271QR2DKR-ND - IC ACCELEROMETER XY AXIS 16-QFN MMA6271QR2CT-ND - IC ACCELEROMETER XY AXIS 16-QFN MMA6281QT-ND - IC ACCELEROMETER XZ AXIS 16-QFN MMA6281QR2TR-ND - IC ACCELEROMETER XZ AXIS 16-QFN MMA6280QT-ND - IC ACCELEROMETER XZ AXIS 16-QFN MMA7261QT-ND - IC ACCELEROMETER XYZ AXIS 16-QFN MMA6271QR2TR-ND - IC ACCELEROMETER XY AXIS 16-QFN MMA6271QT-ND - IC ACCELEROMETER XY AXIS 16-QFN 更多... |
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I/O Registers
MC68HC908JW32 Data Sheet, Rev. 6
Freescale Semiconductor
115
These I/O registers control and monitor operation of the TIM:
TIM status and control register (TSC)
TIM counter registers (TCNTH:TCNTL)
TIM counter modulo registers (TMODH:TMODL)
TIM channel status and control registers (TSC0, TSC1)
TIM channel registers (TCH0H:TCH0L, TCH1H:TCH1L)
8.9.1 TIM Status and Control Register
The TIM status and control register (TSC):
Enables TIM overflow interrupts
Flags TIM overflows
Stops the TIM counter
Resets the TIM counter
Prescales the TIM counter clock
TOF — TIM Overow Flag Bit
This read/write flag is set when the TIM counter reaches the modulo value programmed in the TIM
counter modulo registers. Clear TOF by reading the TIM status and control register when TOF is set
and then writing a logic 0 to TOF. If another TIM overflow occurs before the clearing sequence is
complete, then writing logic 0 to TOF has no effect. Therefore, a TOF interrupt request cannot be lost
due to inadvertent clearing of TOF. Reset clears the TOF bit. Writing a logic 1 to TOF has no effect.
1 = TIM counter has reached modulo value
0 = TIM counter has not reached modulo value
TOIE — TIM Overflow Interrupt Enable Bit
This read/write bit enables TIM overflow interrupts when the TOF bit becomes set. Reset clears the
TOIE bit.
1 = TIM overflow interrupts enabled
0 = TIM overflow interrupts disabled
TSTOP — TIM Stop Bit
This read/write bit stops the TIM counter. Counting resumes when TSTOP is cleared. Reset sets the
TSTOP bit, stopping the TIM counter until software clears the TSTOP bit.
1 = TIM counter stopped
0 = TIM counter active
NOTE
Do not set the TSTOP bit before entering wait mode if the TIM is required
to exit wait mode. Also, when the TSTOP bit is set and the timer is
configured for input capture operation, input captures are inhibited until the
TSTOP bit is cleared.
Address: $000A
Bit 7
654321
Bit 0
Read:
TOF
TOIE
TSTOP
00
PS2
PS1
PS0
Write:
0
TRST
Reset:
00100000
= Unimplemented
Figure 8-4. TIM Status and Control Register (TSC)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 1300060737 | CORDSET FEMALE 12' 16/4 PVC |
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| 1300060241 | CORDSET FEMALE 20' 16/3 PVC |
| 1300100221 | CORDSET MALE-FEMALE 6' 16/3 PVC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| RD316T93W | 制造商:Eaton Corporation 功能描述:RD 3P 1600A W/DIGITRIP 910 TRIP UNIT W/LS FUNCTION |
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