參數(shù)資料
型號： PNX1301
廠商： NXP Semiconductors N.V.
英文描述： Media Processors
中文描述： 媒體處理器
文件頁數(shù)： 211/548頁
文件大?。?/td> 6050K
代理商： PNX1301
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PRELIMINARY SPECIFICATION
14-1
Image Coprocessor
Chapter 14
14.1
IMAGE COPROCESSOR OVERVIEW
In this document, the generic PNX1300 name refers
to the PNX1300 Series, or the PNX1300/01/02/11
products.
The Image Coprocessor (ICP) connects to the PNX1300
on-chip data highway to perform SDRAM block read and
write actions. It also connects to the PCI interface to al-
low block write transactions across PCI.
The major functions of the ICP are:
Filter an image by reading the image from SDRAM
and writing the image back to SDRAM, while apply-
ing a user-defined polyphase filter with optional hori-
zontal up- or down-scaling.
Filter an image by reading the image from SDRAM
and writing the image back to SDRAM, while apply-
ing a user defined polyphase filter with optional verti-
cal up- or down-scaling.
Filter an image and convert it from planar to RGB or
YUV composite by reading the image from SDRAM
and writing the image out to PCI bus memory (graph-
ics card) or SDRAM, while performing horizontal
scaling and conversion to one of a several RGB or
YUV formats. The programmer can add optional bit-
map masking to selectively enable/disable pixel
writes to PCI (to refresh only the exposed part of a
video window) and an optional image overlay with
alpha blending and optional chroma keying (PCI out-
put only).
Move an image by reading the image from SDRAM
and writing it back to SDRAM.
All of the ICP functions move and transform data from
memory to memory or memory to the PCI bus. Hence,
the DSPCPU can use the ICP in a time-sharing fashion
to simultaneously achieve:
1. Vertical and horizontal resizing/subsampling on the
image stream from the Video In (VI) unit.
2. Vertical and horizontal resizing/upsampling on the im-
age stream sent to the Video Out (VO) unit.
3. Presentation of a collection of live video windows with
programmable up and down scaling and arbitrary
overlap configuration on PCI graphics cards.
1
Full 2D scaling and filtering requires two passes over the
data: one for horizontal scaling and filtering and one for
vertical scaling and filtering.
Figure 14-1
shows a block diagram of the PNX1300 with
the ICP.
Figure 14-2
shows a block diagram of the inter-
nal structure of the ICP. The ICP contains a 5-tap filter,
YUV to RGB converter, an overlay and alpha blending
unit, and an output formatter. These blocks communicate
with each other through FIFOs that also buffer the block
data to and from the PNX1300 Data Highway. The ICP
uses a microprogram-controlled sequencer to control its
internal timing. The program for this sequencer is in a ta-
ble in SDRAM. The ICP reads the appropriate portion
from the SDRAM each time the ICP is commanded to
perform a function. Microprogram control simplifies and
minimizes the ICP hardware and increases the flexibility
of the ICP to perform additional tasks without adding
hardware.
14.2
REQUIREMENTS
14.2.1
Functions
The major functions of the ICP include:
1. Read an image from SDRAM and write the image
back to SDRAM, while applying a user defined
polyphase filter with optional up or down scaling in
horizontal direction.
2. Read an image from SDRAM and write the image
back to SDRAM, while applying a user defined
polyphase filter with optional up or down scaling in
vertical direction.
3. Read an image from SDRAM and write the image out
to PCI bus memory (graphics card) or SDRAM, while
performing horizontal scaling and conversion to one
of a several RGB and YUV formats. The PCI output
mode includes optional bitmap masking to selectively
enable/disable pixel writes to PCI (to refresh only the
exposed part of a video window) and optional RGB
overlay with alpha blending and optional chroma key-
ing.
14.2.2
Bandwidth
ICP bandwidth can be estimated from the worst-case im-
age processing bandwidth. If the worst case image is
1024 x 768 at 30 Hz in YUV 4:2:2 format, the pixel rate is
1024 x 768 x 30 = 23.59 Mpix/sec. For YUV 4:2:2 image
coding at 2 bytes per pixel, this is 23.59 x 2 = 47.19 MB/
1.
Note that function 2 and 3 don
’
t normally occur simulta-
neously, and if an application attempts both simulta-
neously, some performance limitations are incurred.
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PDF描述
PNX1302 Media Processors
PNX1311 Media Processors
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參數(shù)描述
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PNX1301EH,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/180MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
PNX1301EH/G,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC NEXPERIA MEDIA PROC 180MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
PNX1302 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Media Processors
PNX1302EH 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/200MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風格:SMD/SMT
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