參數(shù)資料
型號: PNX1301
廠商: NXP Semiconductors N.V.
英文描述: Media Processors
中文描述: 媒體處理器
文件頁數(shù): 152/548頁
文件大?。?/td> 6050K
代理商: PNX1301
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PNX1300/01/02/11 Data Book
Philips Semiconductors
9-8
PRELIMINARY SPECIFICATION
9.9
AUDIO OUT OPERATION
Figure 9-6
,
Table 9-11
and
Table 9-12
describe the func-
tion of the control and status fields of the AO unit. To en-
sure compatibility with future devices, any undefined or
reserved MMIO bits should be ignored when read, and
written as zeroes
The AO unit is reset by a PNX1300 hardware reset, or by
writing 0x80000000 to the AO_CTL register. The AO unit
is not affected by DSPCPU reset initiated through the
BIU_CTL register. Either reset method sets all MMIO
fields as indicated in the tables.
The timestamp counter is reset by TRI_RESET# or by
DSPCPU reset initiated through BIU_CTL. It is not affect-
ed by AO_CTL reset. This ensures that the timestamp
counter
CCCOUNT register.
After an AO reset, 5 AO_SCK clock cycles are required
to stabilize the internal circuitry before enabling Audio
Out. This can be accomplished by programming the
AO_FREQ and AO_SERIAL registers to start AO_SCK
generation then waiting for the appropriate 5 AO_SCK
cycle interval.
Programing of the AO_SERIAL MMIO register needs to
follow the following sequence order:
set AO_FREQ to ensure that a valid clock is gener-
ated (Only when AO is the master of the audio clock
system)
MMIO(AO_CTL) = 1 << 31; /* Software Reset */
stays
synchronous
with
the
DSPCPU
Figure 9-6. AO status/control field MMIO layout.
MMIO_base
offset:
AO_STATUS (r/w)
0x10 2000
AO_CTL (r/w)
0x10 2004
AO_SERIAL (r/w)
0x10 2008
SCKDIV
AO_FRAMING (r/w)
0x10 200C
AO_FREQ (r/w)
0x10 2010
AO_BASE1 (r/w)
0x10 2014
FREQUENCY
BUF1_ACTIVE
UNDERRUN
HBE (Highway bandwidth error)
AO_BASE2 (r/w)
0x10 2018
BASE2
AO_SIZE (r/w)
0x10 201C
SIZE (in samples)
31
0
3
7
11
15
19
23
27
BASE1
BUF2_EMPTY
BUF1_EMPTY
RESET
TRANS_ENABLE
TRANS_MODE
SIGN_CONVERT
LITTLE_ENDIAN
0
UDR_INTEN
HBE_INTEN
BUF2_INTEN
BUF1_INTEN
ACK_UDR
ACK_HBE
ACK2
ACK1
WSDIV
DATAMODE
CLOCK_EDGE
POLARITY
LEFTPOS
RIGHTPOS
SSPOS
0
0
0
0
0
0
0
0
0
0
0
SLEEPLESS
AO_CC (r/w)
0x10 2020
AO_CFC (r/w)
0x10 2024
CC1_POS
CC2_POS
CC2
CC1
CC1_EN
CC2_EN
WS_PULSE
CC_BUSY
NR_CHAN
0
0
0
0
0
0
31
0
3
7
11
15
19
23
27
31
0
3
7
11
15
19
23
27
31
0
3
7
11
15
19
23
27
31
0
3
7
11
15
19
23
27
RESERVED
SSPOS[4]
AO_TSTAMP (r/o)
0x10 2028
TIMESTAMP
31
0
3
7
11
15
19
23
27
SER_MASTER
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PDF描述
PNX1302 Media Processors
PNX1311 Media Processors
PNX1500G Connected Media Processor
PNX1501G Connected Media Processor
PNX1502G Connected Media Processor
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參數(shù)描述
PNX1301EH 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/180MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
PNX1301EH,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/180MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
PNX1301EH/G,557 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC NEXPERIA MEDIA PROC 180MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
PNX1302 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Media Processors
PNX1302EH 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/200MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT