參數(shù)資料
型號(hào)： PNX1301
廠商： NXP Semiconductors N.V.
英文描述： Media Processors
中文描述： 媒體處理器
文件頁數(shù)： 100/548頁
文件大小： 6050K
代理商： PNX1301
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PNX1300/01/02/11 Data Book
Philips Semiconductors
6-4
PRELIMINARY SPECIFICATION
6.2
CLOCK GENERATOR
The VI block can operate in two distinct clocking modes,
as controlled by the VI_CLOCK control register (see
Figure 6-11
).
SELFCLOCK = 0:
‘
External clocking mode
’
.
This is the
most common mode of operation. In this mode, the
VI_CLK pin is an asynchronous clock input. All other in-
puts are sampled on positive edges of the VI_CLK clock
signal. On-chip synchronizers ensure reliable asynchro-
nous capture. This mode can be combined with DIAG-
MODE, in which case the EVO clock acts as the asyn-
chronous clock source. In external clocking mode, the
value of DIVIDER is ignored.
SELFCLOCK = 1:
‘
Internal clocking mode
”
.
This
mode is typically intended for use with external A/D con-
verters or other sources that require a clock. In this
mode, VI_CLK is an output pin. Positive edges of
VI_CLK are used to sample all other inputs. The gener-
ated clock frequency can be programmed using the DI-
VIDER field in the VI_CLOCK register.
On RESET, VI_CLOCK is set to zero, i.e. external clock-
ing mode is the default with DIVIDER ignored.
6.3
FULLRES CAPTURE MODE
In
fullres capture
mode, the VI unit receives all three vid-
eo components Y, U, and V, as well as synchronization
information (SAV and EAV codes) on the VI_DATA[7:0]
pins in CCIR656 format. See
Figure 6-8
. The three video
components Y, U, and V are separated into three differ-
ent streams. Each component is written in packed form
into separate Y, U, and V buffers in the SDRAM. This is
commonly called a
planar
format
(see
Figure 6-10
).
The CCIR656 standard specifies that the camera has to
obey the sampling rules illustrated in
Figure 6-5
. VI is ca-
pable of chrominance resampling, and can produce sam-
ples in memory in two ways:
VI_CTL.SC=0.
‘
Co-sited sampling
’
places luminance
and chrominance samples in memory without any modi-
fication. Hence, a planar format results with sampling po-
sitions as per co-sited luminance and chrominance YUV
4:2:2 convention.
VI_DATA[9:0]
VI_DVALID
VI_CLK
PNX1300
logic
‘
1
’
Analog video
10-bit Video A/D
Figure 6-4. VI connected to a 10-bit video A/D converter.
f
VICLK
f
-----------------------
=
1.
The
planar format
is most suitable as input to software
compression algorithms.
Chrominance (U,V)
samples
Luminance
samples
Figure 6-5. Camera YUV 4:2:2 sampling (co-sited luminance/chrominance).
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PNX1301EH,557 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/180MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
PNX1301EH/G,557 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC NEXPERIA MEDIA PROC 180MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
PNX1302 制造商:PHILIPS 制造商全稱:NXP Semiconductors 功能描述:Media Processors
PNX1302EH 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC MEDIA PROCESSOR PNX13XX/200MHZ RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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