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參數(shù)資料
| 型號： | PLUS405-55N |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | PLD |
| 英文描述： | Programmable logic sequencer 16 】 64 】 8 |
| 中文描述： | OT PLD, 8 ns, PDIP28 |
| 封裝： | 0.600 INCH, PLASTIC, DIP-28 |
| 文件頁數(shù)： | 16/20頁 |
| 文件大小： | 327K |
| 代理商： | PLUS405-55N |
Philips Semiconductors
Product specification
PLUS405-37/-45
Programmable logic sequencers
(16
×
64
×
8)
1996 Nov 12
16
PLUS405 PROGRAM TABLE
NOTES:
1.
The device is shipped with all links initially intact. Thus, a background of “0” for all Terms, and an “H” for the IN/E and H for the clock option, exists in the table, shown BLANK instead
for clarity.
Unused Cn Im, and Ps bits are normally programmed Don’t Care (—).
Unused Transition Terms can be left blank for future code modification, or programmed as (—) for maximum speed.
2.
3.
INACTIVE OR
TOGGLE
SET
N7
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
PIN NO.
PIN
LABELS
2
0
2
1
2
2
2
3
2
4
2
5
2
6
2
7
2
3
4
5
6
7
8
9
1
0
1
1
1
2
1
3
1
5
1
6
1
7
1
8
C1 C0
COMP.
ARRAY
INPUT (Im)
AND
PRESENT STATE (Ps)
NEXT STATE (Ns)
OR
OUTPUT (Fr)
CLOCK 1/2
INITIALIZATION/OUTPUT ENABLE
C
P
C
C
R
D
P
I15 I14 I13 I12 I11 I10
I9
I8
I7 I6
I5
I4
I3
I2 I1
I0 P7 P6 P5 P4 P3 P2 P1 P0
N6 N5 N4 N3 N2 N1 N0 F7 F6 F5 F4 F3 F2 F1 F0
OPTIONS
OR
AND
INIT
OE
CLK1 ONLY
CLK1 AND 2
H
L
L
H
INIT/OE
CLK1/
CLK2
Ns, Fr
RESET
NO CHANGE
L
–
H
0
INACTIVE
GENERATE
PROPAGATE
TRANSPARENT
0
–
A
Cn
INACTIVE
I, P
I, P
DON’T CARE
0
–
H
Im, Ps
L
SP00263
相關(guān)PDF資料 |
PDF描述 |
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