參數(shù)資料
型號： PLL1708DBQ
英文描述： 3.3 V DUAL PLL MULTICLOCK GENERATOR
中文描述： 3.3 V雙鎖相環(huán)MULTICLOCK發(fā)生器
文件頁數(shù)： 5/22頁
文件大?。?/td> 171K
代理商： PLL1708DBQ
SLES065
–
DECEMBER 2002
www.ti.com
5
PLL1707 Terminal Functions
TERMINAL
NAME
I/O
DESCRIPTION
NO.
AGND
9
–
Analog ground
SCKO1 frequency selection control(1)
CSEL
12
I
DGND1
4
–
Digital ground 1
DGND2
16
–
Digital ground 2
DGND3
17
–
Digital ground 3
Sampling frequency group control 1(1)
Sampling frequency group control 2(1)
FS1
5
I
FS2
6
I
MCKO1
14
O
27-MHz master clock output 1
MCKO2
15
O
27-MHz master clock output 2
SCKO0
18
O
System clock output 0 (33.8688 MHz fixed)
SCKO1
19
O
System clock output 1 (selectable for 48 kHz)
SCKO2
2
O
System clock output 2 (256 fS selectable)
System clock output 3 (384 fS selectable)
Sampling rate control(1)
SCKO3
3
O
SR
7
I
VCC
VDD1
VDD2
VDD3
XT1
8
–
Analog power supply, 3.3 V
1
–
Digital power supply 1, 3.3 V
13
–
Digital power supply 2, 3.3 V
20
–
Digital power supply 3, 3.3 V
10
I
27-MHz crystal oscillator, or external clock input
XT2
(1)Schmitt-trigger input with internal pulldown.
11
O
27-MHz crystal oscillator, must be OPEN for external clock input mode
相關(guān)PDF資料
PDF描述
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PLL1708DBQR 3.3 V DUAL PLL MULTICLOCK GENERATOR
PLL1707 3.3 V DUAL PLL MULTICLOCK GENERATOR
PLL1708 3.3 V DUAL PLL MULTICLOCK GENERATOR
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參數(shù)描述
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