參數(shù)資料
型號: PLB2224
英文描述: 24+2G Switch On a Chip with Embedded Memory
中文描述: 24第二代開關(guān)與嵌入式內(nèi)存芯片
文件頁數(shù): 62/219頁
文件大小: 2975K
代理商: PLB2224
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GREEN
PLB 2224
Data Structure
Data Sheet
62
2002-06-03
4.2
Indirect Access to the Memories
A brief description on how to access the different memories in PLB 2224 is given below.
Two registers (memory upper address register and memory access register) are defined
for the purpose of cpu indirect access of internal memories.
These two registers are defined below:
Memory Upper Address Register
Name
:
mem_u_addr
Offset
:
0x80
Access
:
Read/Write
Description
This register is used to store the upper address of the memory. It should be combined
with the lower bits in mem_access register to have the complete address offset. The final
memory address for each access is concatenated from mem_addr[20:11] from
mem_u_addr register and mem_addr[10:1] from mem_access register.
Table 21
Memory Upper Address Register
Bits
Field
Name
Block
(Access)
Initial Value
0
MEM
(R/W)
x
Description
31:25
24:21
rsv
blk_sel_msb
[3:0]
Reserved
The value of this filed indicates which
memory will be accessed for CPU to READ
or WRITE mem_access register. The
definition of memory access is described
below:
0 - 1: EDRAM block #0 to #1
,
2 - 7: reserved
.
8: MIB counters
.
9: ARL
.
10: PQC
.
11:15: reserved
.
20:11
mem_addr
[20:11]
MEM_IF
(R/W)
x
0
Upper address of memory access. The
definition of each access is described in
blk_sel_msb[]
field above.
Reserved
10:0
rsv
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PDF描述
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