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參數(shù)資料
| 型號： | PLB2224 |
| 英文描述： | 24+2G Switch On a Chip with Embedded Memory |
| 中文描述： | 24第二代開關(guān)與嵌入式內(nèi)存芯片 |
| 文件頁數(shù)： | 110/219頁 |
| 文件大?。?/td> | 2975K |
| 代理商： | PLB2224 |
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GREEN
PLB 2224
Interface Description
Data Sheet
110
2002-06-03
AD[31:0]
I
AD[31..0] is a time-multiplexed address/data bus, with each bus
transaction consisting of an address phase followed by one or
more data phases. The FRAME_n signal identifies the start of
an address phase. The data phases occur when both IRDY_n
and TRDY_n are asserted.
C/BE_n[3:0]
I
Command and byte enables are multiplexed on C/BE_n[]. The
bus command is indicated during the address phase of a
transaction. The byte enables are active during the data phases
of a transaction and indicate which bytes of the 32-bit data
transferred are valid.
FRAME_n is driven by the current bus master to indicate the
beginning and the duration of a bus operation. When FRAME_n
is first asserted, the address and command Signals are present
on AD[] and C/BE_n[]. FRAME_n remains asserted during the
data operation and is de-asserted
to identify the end of a data operation.
Target ready. TRDY_n is output by a target towards the initiator
to indicate that the target can complete a data operation.
FRAME_n
I
TRDY_n
O
IDSEL
I
Initialization device select. IDSEL is a chip select
forconfiguration read and write transactions.
Initiator ready. IRDY_n is output by a bus master towards a
target to indicate that the bus master can complete a data
operation.
PAR is the signal of even parity calculated on the linking of
events in the AD[] and C/BE_n[] fields. It is always calculated
by the device providing data and by the bus master during
address phases. PAR must be valid one clock following its
corresponding data (or address) on the PCI bus.
PERR_n indicates data parity errors on data transactions
IRDY_n
I
PAR
B
PERR_n
O
SERR_n
O
SERR_n indicates system errors and address parity errors (or
data parity errors during special cycles).
Target asserts DEVSEL_n as a decode acknowledgment when
the address and bus command are valid.
DEVSEL_n
O
STOP_n
O
STOP_n is asserted by a target to request that the bus master
stops the current transaction.
Signal Name Signal
Type
Signal Description
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PLBYTEBLASTERCABLE | 60MHz, Rail-to-Rail Output, 1.9nV/rtHz, 1.2mA Op Amp Family; Package: SO; No of Pins: 8; Temperature Range: -40°C to +85°C |
| PLC01-6 | 60MHz, Rail-to-Rail Output, 1.9nV/rtHz, 1.2mA Op Amp Family; Package: SSOP; No of Pins: 16; Temperature Range: 0°C to +70°C |
| PLC03-6 | 500mA, 200MHz xDSL Line Driver in 16-Lead SSOP Package; Package: SSOP; No of Pins: 16; Temperature Range: -40°C to +85°C |
| LCO3-6 | Direct ProTek Replacement:PLC03-6 |
| PLC16V8H35N | Dual 500mA, Differential xDSL Line Driver in 28-Lead TSSOP Package; Package: TSSOP; No of Pins: 28; Temperature Range: 0°C to +70°C |
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參數(shù)描述 |
|---|---|
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