參數(shù)資料
型號(hào)： PID9q-604e
廠商： IBM Microeletronics
英文描述： 32-Bit RISC Microprocessor(32位精簡(jiǎn)指令集微處理器)
中文描述： 32位RISC微處理器（32位精簡(jiǎn)指令集微處理器）
文件頁(yè)數(shù)： 21/29頁(yè)
文件大?。?/td> 543K
代理商： PID9Q-604E
9/17/99 Revision 1.4
PID9q-604e Hardware Datasheet
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
21
Table 11. PLL Configuration
PLL_CFG
[0–3]
CPU/
SYSCLK
Ratio
VCO
Multiplier
CPU Frequency in MHz
(VCO Frequency in MHz)
Bin
Dec
Bus
25
MHz
Bus
33.3
MHz
Bus
40
MHz
Bus
50
MHz
Bus
60
MHz
Bus
66.6
MHz
Bus
83.3
MHz
Bus
100
MHz
0000
0
1:1
x2
—
—
—
—
—
—
—
—
0001
1
1:1
x8
—
—
40
(320)
50
(400)
60
(480)
66
(533)
83.3
(666)
—
1100
12
1.5:1
x2
—
—
—
—
—
—
—
—
0100
4
2:1
x2
—
—
—
—
—
—
—
200
(400)
0110
6
2.5:1
x2
—
—
—
—
—
—
208
(416)
250
(500)
1000
8
3:1
x2
—
—
—
—
—
200
(400)
250
(500)
300
(600)
1110
14
3.5:1
x2
—
—
—
—
210
(420)
233
(466)
292
(584)
350
(700)
1010
10
4:1
x2
—
—
—
200
(400)
240
(480)
266
(532)
333
(666)
—
0111
7
4.5:1
x2
—
—
—
225
(450)
270
(540)
300
(600)
—
—
1011
11
5:1
x2
—
—
200
(400)
250
(500)
300
(600)
333
(666)
—
—
1001
9
5.5:1
x2
—
—
220
(440)
275
(550)
330
(660)
—
—
—
1101
13
6:1
x2
—
200
(400)
240
(480)
300
(600)
—
—
—
—
0101
5
6.5:1
x2
—
216
(433)
260
(520)
325
(650)
—
—
—
—
0010
2
7:1
x2
—
233
(466)
280
(560)
350
(700)
—
—
—
—
0011
3
PLL bypass
1111
15
Clock off
Notes:
1. Some PLL configurations may select bus, CPU, or VCO frequencies which are not supported; see
Section 1.4.2.2, “Input AC Specifications,” for valid SYSCLK and VCO frequencies.
2. In PLL-bypass mode, the SYSCLK input signal clocks the internal processor directly, the PLL is
disabled, and the bus mode is set for 1:1 mode operation. This mode is intended for factory use only.
Note
: The AC timing specifications given in this document do not apply in PLL-bypass mode.
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