參數(shù)資料
型號(hào)： PIC16LF877T-20/PT
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP44
封裝： 10 X 10 MM, 1 MM HEIGHT, PLASTIC, TQFP-44
文件頁數(shù)： 30/200頁
文件大小： 1378K
代理商： PIC16LF877T-20/PT
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PIC16F87X
1998 Microchip Technology Inc.
Preliminary
DS30292A-page 125
Figure 11-4 shows the conversion sequence, and the
terms that are used. Acquisition time is the time that the
A/D module’s holding capacitor is connected to the
external voltage level. Then there is the conversion time
of 12 TAD, which is started when the GO bit is set. The
sum of these two times is the sampling time. There is a
minimum acquisition time to ensure that the holding
capacitor is charged to a level that will give the desired
accuracy for the A/D conversion.
FIGURE 11-4: A/D CONVERSION SEQUENCE
11.1
A/D Acquisition Requirements
For the A/D converter to meet its specied accuracy,
the charge holding capacitor (CHOLD) must be allowed
to fully charge to the input channel voltage level. The
analog input model is shown in Figure 11-5. The source
impedance (RS) and the internal sampling switch (RSS)
impedance directly affect the time required to charge
the capacitor CHOLD. The sampling switch (RSS)
impedance varies over the device voltage (VDD),
Figure 11-5. The maximum recommended impedance
for analog sources is 10 kW. As the impedance is
decreased, the acquisition time may be decreased.
After the analog input channel is selected (changed)
this acquisition must be done before the conversion
can be started.
To
calculate
the
minimum
acquisition
time,
Equation 11-1 may be used. This equation assumes
that 1/2 LSb error is used (1024 steps for the A/D). The
1/2 LSb error is the maximum error allowed for the A/D
to meet its specied resolution.
Example 11-1 shows the calculation of the minimum
required acquisition time TACQ.
This calculation is based on the following application
system assumptions.
CHOLD
=
120 pF
Rs
=
10 k
Conversion Error
≤
1/2 LSb
VDD
=
5V
→ Rss = 7 k
(see graph in Figure 11-5)
Temperature
=
50
°C (system max.)
VHOLD
=
0V @ time = 0
EQUATION 11-1:
ACQUISITION TIME
Acquisition Time
A/D Conversion Time
A/D Sample Time
When A/D holding capacitor starts to charge.
After A/D conversion, or when new A/D channel is selected
When A/D conversion is started
(setting the GO bit)
A/D conversion complete, result is loaded in ADRES register.
Holding capacitor begins acquiring voltage level on selected
channel ADIF bit is set
TACQ
=
Amplier Settling Time + Holding Capacitor Charging Time + Temperature Coefcient
=
TAMP + TC + TCOFF
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