參數(shù)資料
型號： PIC16F785
廠商： Microchip Technology Inc.
英文描述： 20-Pin Flash-Based 8-Bit CMOS Microcontroller with Two-Phase Asychronous Feedback PWM, Dual High-Speed Comparators and Dual Operational Amplifiers
中文描述： 20引腳基于閃存的8兩相異步反饋的PWM，雙高位CMOS微控制器的高速比較器和雙運算放大器
文件頁數(shù)： 63/178頁
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代理商： PIC16F785
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2004 Microchip Technology Inc.
Preliminary
DS41249A-page 61
PIC16F785
9.0
COMPARATOR MODULE
The comparator module has two separate voltage
comparators: Comparator C1 and Comparator C2.
Each comparator offers the following list of features:
Control and configuration register
Comparator output available externally
Programmable output polarity
Interrupt-on-change flags
Wake-up from SLEEP
Configurable as feedback input to the PWM
Programmable four input multiplexer
Programmable two input reference selections
Programmable speed/power
Output synchronization to Timer1 clock input
(Comparator C2 only)
9.1
Control Registers
Both comparators have separate control and configura-
tion registers: CM1CON0 for C1 and CM2CON0 for C2.
In addition, Comparator C2 has a second control
register, CM2CON1, for synchronization control and
simultaneous reading of both comparator outputs.
9.1.1
COMPARATOR C1 CONTROL
REGISTER
The CM1CON0 register (shown in Register 9-1)
contains the control and Status bits for the following:
Comparator enable
Comparator input selection
Comparator reference selection
Output mode
Comparator speed
Setting C1ON (CM1CON0<7>) enables Comparator
C1 for operation.
Bits C1CH<1:0> (CM1CON0<1:0>) select the compar-
ator input from the four analog pins AN<7:5,1>.
Setting C1R (CM1CON0<2>) selects the C1V
REF
out-
put of the comparator voltage reference module as the
reference voltage for the comparator. Clearing C1R
selects
the
C1IN+
RA0/AN0/C1IN+/ICSPDAT pin.
input
on
the
The output of the comparator is available internally via
the C1OUT flag (CM1CON0<6>). To make the output
available for an external connection, the C1OE bit
(CM1CON0<5>) must be set.
The polarity of the comparator output can be inverted
by setting the C1POL bit (CM1CON0<4>). Clearing
C1POL results in a non-inverted output.
A complete table showing the output state versus input
conditions and the polarity bit is shown in Table 9-1.
C1SP (CM1CON0<3>) configures the speed of the
comparator. When C1SP is set, the comparator oper-
ates at its normal speed. Clearing C1SP operates the
comparator in a slower, low-power mode.
Note:
To use AN<7:5,1> as analog inputs the
appropriate bits must be programmed to ‘
1
’
in the ANSEL0 register.
TABLE 9-1:
C1OUTPUT STATE VERSUS
INPUT CONDITIONS
Input Condition
C1POL
C1OUT
C1VN > C1VP
C1VN < C1VP
C1VN > C1VP
C1VN < C1VP
0
0
1
1
0
1
1
0
Note 1:
The internal output of the comparator is
latched at the end of each instruction
cycle. External outputs are not latched.
2:
The C1 interrupt will operate correctly
with C1OE set or cleared.
3:
To
output
RA2/AN2/T0CKI/INT/C1OUT:
(C1OE=1) & (C1ON=1) & (TRISA<2>=0).
C1
on
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