參數(shù)資料
型號(hào)： PIC16C662T-20I/P
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 20 MHz, RISC MICROCONTROLLER, PDIP40
封裝： 0.600 INCH, PLASTIC, DIP-40
文件頁(yè)數(shù)： 101/136頁(yè)
文件大?。?/td> 634K
代理商： PIC16C662T-20I/P
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1996 Microchip Technology Inc.
Preliminary
DS30559A-page 67
PIC16C64X & PIC16C66X
9.5.1
RB0/INT INTERRUPT
The external interrupt on the RB0/INT pin is edge trig-
gered: either rising if bit INTEDG (OPTION<6>) is set,
or falling, if bit INTEDG is clear. When a valid edge
appears
on
the
RB0/INT
pin,
ag
bit
INTF
(INTCON<1>) is set. This interrupt can be enabled/dis-
abled
by
setting/clearing
enable
bit
INTE
(INTCON<4>). The INTF bit must be cleared in soft-
ware in the interrupt service routine before re-enabling
this interrupt. The RB0/INT interrupt can wake-up the
processor from SLEEP, if bit INTE was set prior to
going into SLEEP. The status of the GIE bit decides
whether or not the processor branches to the interrupt
vector following wake-up. See Section 9.8 for details
on SLEEP and Figure 9-19 for timing of wake-up from
SLEEP through RB0/INT interrupt.
9.5.2
TMR0 INTERRUPT
An overow (FFh
→ 00h) in the TMR0 register will
set the T0IF (INTCON<2>) bit. The interrupt can
be
enabled/disabled
by
setting/clearing
T0IE
(INTCON<5>) bit. For operation of the Timer0 module,
see Section 6.0.
9.5.3
PORTB INTERRUPT
An input change on any bit of PORTB<7:4> sets ag bit
RBIF (INTCON<0>). The interrupt can be enabled/dis-
abled
by
setting/clearing
enable
bit
RBIE
(INTCON<4>). For operation of PORTB (Section 5.2).
9.5.4
COMPARATOR INTERRUPT
See Section 7.6 for complete description of the com-
parator interrupt.
FIGURE 9-16: RB0/INT PIN INTERRUPT TIMING
Q2
Q1
Q3
Q4
Q2
Q1
Q3
Q4
Q2
Q1
Q3
Q4
Q2
Q1
Q3
Q4
Q2
Q1
Q3
Q4
OSC1
CLKOUT
INT pin
INTF ag
(INTCON<1>)
GIE bit
(INTCON<7>)
INSTRUCTION FLOW
PC
Instruction
fetched
Instruction
executed
Interrupt Latency
PC
PC+1
0004h
0005h
Inst (0004h)
Inst (0005h)
Dummy Cycle
Inst (PC)
Inst (PC+1)
Inst (PC-1)
Inst (0004h)
Dummy Cycle
Inst (PC)
—
1
4
5
1
Note 1: INTF ag is sampled here (every Q1).
2: Interrupt latency = 3-4 Tcy where Tcy = instruction cycle time.
Latency is the same whether Inst (PC) is a single cycle or a 2-cycle instruction.
3: CLKOUT is available only in RC oscillator mode.
4: For minimum width of INT pulse, refer to AC specs.
5: INTF is enabled to be set anytime during the Q4-Q1 cycles.
2
3
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PDF描述
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