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參數(shù)資料
| 型號(hào)： | PCD8544U |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 顯示驅(qū)動(dòng)器 |
| 英文描述： | 48 x 84 pixels matrix LCD controller/driver |
| 中文描述： | LIQUID CRYSTAL DISPLAY DRIVER, UUC168 |
| 封裝： | BUMP, DIE-168 |
| 文件頁數(shù)： | 20/32頁 |
| 文件大?。?/td> | 154K |
| 代理商： | PCD8544U |
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1999 Apr 12
20
Philips Semiconductors
Product specification
48
×
84 pixels matrix LCD controller/driver
PCD8544
12 AC CHARACTERISTICS
Notes
1.
2.
3.
RES may be LOW before V
DD
goes HIGH.
t
h5
is the time from the previous SCLK positive edge (irrespective of the state of SCE) to the negative edge of SCE
(see Fig.15).
SYMBOL
PARAMETER
CONDITIONS
MIN.
TYP.
MAX.
UNIT
f
OSC
f
clk(ext)
f
frame
t
VHRL
t
WL(RES)
oscillator frequency
external clock frequency
frame frequency
V
DD
to RES LOW
RES LOW pulse width
20
10
0
(2)
100
34
32
67
65
100
30
kHz
kHz
Hz
ms
ns
f
OSC
or f
clk(ext)
= 32 kHz; note 1
Fig.16
Fig.16
Serial bus timing characteristics
f
SCLK
T
cy
t
WH1
t
WL1
t
su2
t
h2
t
WH2
t
h5
t
su3
t
h3
t
su4
t
h4
clock frequency
clock cycle SCLK
SCLK pulse width HIGH
SCLK pulse width LOW
SCE set-up time
SCE hold time
SCE min. HIGH time
SCE start hold time; note 3
D/C set-up time
D/C hold time
SDIN set-up time
SDIN hold time
V
DD
= 3.0 V
±
10%
All signal timing is based on
20% to 80% of V
DD
and
maximum rise and fall times of
10 ns
0
250
100
100
60
100
100
100
100
100
100
100
4.00
MHz
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
T
frame
f
480
)
-------------------
=
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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