參數(shù)資料
型號: ORLI10G-1BM680
廠商: LATTICE SEMICONDUCTOR CORP
元件分類: FPGA
英文描述: FPGA, 1296 CLBS, 380000 GATES, PBGA680
封裝: PLASTIC, BGA-680
文件頁數(shù): 6/76頁
文件大?。?/td> 1222K
代理商: ORLI10G-1BM680
14
Lattice Semiconductor
Data Sheet
January 15, 2002
and ORLI12G Gbits/s Line Interface FPSC
ORCA ORLI10G Quad 2.5 Gbits/s, 10 Gbits/s
ORLI10G Overview (continued)
1335(F)
Figure 2. 10G (Single-Channel) and 2.5G (Quad-Channel) Modes
DATA
128 OR 64
2.5G MODE
RECEIVE PATH
CORE
LVDS DATA
32 OR 16
FPGA
LVDS CLOCK
LVDS DATA
CORE
FPGA
RX_CLK8_OUT3
32 OR 16
4
DEMUX
FPGA
CORE
LVDS DATA
16
RX_CLK_IN[0]
RX_CLK_IN[3:1]
RX[1:2]VCOP
4
DATA
4
DATA
MUX
TRANSMIT PATH
10G MODE
DIV BY 8
OR
DIV BY 4
DIV BY 8
MUX
LVDS
16
TX_CLK_IN
CORE
128 OR 64
FPGA
DATA
UNUSED
REFERENCE
DATA
TRANSMIT PATH
MUX
32 OR 16
DATA
32 OR 16
DATA
32 OR 16
DATA
LVDS DATA
4
LVDS DATA
4
LVDS DATA
4
DIV BY 8
OR
DIV BY 4
1
LVDS CLOCK
LVDS DATA
RX_CLK8_OUT2
32 OR 16
4
DEMUX
DATA
DIV BY 8
OR
DIV BY 4
1
LVDS CLOCK
LVDS DATA
RX_CLK8_OUT1
32 OR 16
4
DEMUX
DATA
DIV BY 8
OR
DIV BY 4
1
LVDS CLOCK
LVDS DATA
RX_CLK8_OUT0
32 OR 16
4
DEMUX
DATA
DIV BY 8
OR
DIV BY 4
1
RECEIVE PATH
DEMUX
CLOCK
DIV BY 4
TX[1:2]VCOP
4
DIV BY 4
TX_CLK_IN
REFERENCE
CLOCK
TX_CLK_OUT[3:0]
LVDS CLOCKS
TX_[1:2]VCOP
4
RX[1:2]VCO
TX_CLK_OUT[3:0]
TX_[1:2]VCO
TX[1:2]VCO
相關(guān)PDF資料
PDF描述
ORLI10G-2BM416 FPGA, 1296 CLBS, 380000 GATES, PBGA416
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ORLI10G-3BM416 FPGA, 1296 CLBS, 380000 GATES, PBGA416
ORLI10G-3BM680 FPGA, 1296 CLBS, 380000 GATES, PBGA680
ORLI10G1BM680-DB FPGA, 1296 CLBS, 333000 GATES, PBGA680
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參數(shù)描述
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