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參數(shù)資料
| 型號(hào)： | MT9315 |
| 廠商： | Zarlink Semiconductor Inc. |
| 英文描述： | CMOS Acoustic Echo Canceller |
| 中文描述： | 聲學(xué)回聲消除器的CMOS |
| 文件頁(yè)數(shù)： | 15/30頁(yè) |
| 文件大?。?/td> | 361K |
| 代理商： | MT9315 |
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MT9315
Advance Information
14
Timing is over recommended temperature range and recommended power supply voltages.
Table 8 - Reference Level Definition for Timing Measurements
Figure 10 - Master Clock - MCLK
Notes: 1. CMOS output
2. TTL input compatible
3. CMOS input
(see Table 8 for symbol definitions)
AC Electrical Characteristics
- Microport Timing
Characteristics
Sym
Min
Typ
Max
Units
Test Notes
1
Input Data Setup
t
IDS
100
ns
2
Input Data Hold
t
IDH
30
ns
3
Output Data Delay
t
ODD
100
ns
C
L
=150pF
4
Serial Clock Period
t
SCP
500
ns
5
SCLK Pulse Width High
t
SCH
250
ns
6
SCLK Pulse Width Low
t
SCL
250
ns
7
CS Setup-Intel
t
CSSI
200
ns
8
CS Setup-Motorola
t
CSSM
100
ns
9
CS Hold
t
CSH
100
ns
10
CS to Output High Impedance
t
OHZ
100
ns
C
L
=150pF
Characteristic
Symbol
TTL Pin
CMOS Pin
Units
TTL reference level
V
TT
1.5
-
V
CMOS reference level
V
CT
-
0.5*V
DD
V
Input HIGH level
V
H
2.4
0.9*V
DD
V
Input LOW level
V
L
0.4
0.1*V
DD
V
Rise/Fall HIGH measurement point
V
HM
2.0
0.7*V
DD
V
Rise/Fall LOW measurement point
V
HL
0.8
0.3*V
DD
V
MCLK
(3)
V
H
V
L
V
CT
t
MCL
t
MCH
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PDF描述 |
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