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參數(shù)資料
| 型號： | MT9072AV |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA220 |
| 封裝： | 17 X 17 MM, 1.30 MM HEIGHT, MO-192, LBGA-220 |
| 文件頁數(shù)： | 80/275頁 |
| 文件大?。?/td> | 3738K |
| 代理商： | MT9072AV |
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MT9072
Data Sheet
80
Zarlink Semiconductor Inc.
Transmit Error
Insertion
All error insertion controls are
disabled.
L32Z,BPVE,CRCE,FTE,FSE,LOSE,PER
R = 0
Y03
Signaling
All signaling freeze and debounce
functions are disabled and the
transmit signaling type is set such that
A in frame 6 and B in frame 12.
Robbed bit signaling is turned on for
transmitter and receiver.
CSIGEN,RBEN,TSDB,RSDB,RFL,SM1-0
,SIP1-0= hex 200
Y04
Loopbacks
All loopbacks deactivated; ready to
send receive framed in band loopback
codes.
DLBK,RLBK,STLBK,PLBK,TLU,
TLD = 0
Y05
Data Link
Data Link is deactivated, hence bit
oriented message, and HDLC are
also disabled.
#,#,#,#,HCH4:0,HPAYSEL,E1.5CK,
DLCK,EDLEN,BOMEN,HDLCEN,H1R6
4 = 0
Y06
Bit Oriented
Message
Registers
The Transmit Bit oriented message
register and Receive Bit oriented
Match register are cleared.
TxBOM7:0,
RXBOMM7:0 = 0
Y07-Y08
In band loopback
activation codes
The transmit and expected receive
inband loopback codes are set to
T1.403 defaults.
TXLACL1-0,TXLAC7-0 = binary00
00000001
TXLDCL1-0,TXLDC7-0 = binary 01
00001001
RXLACL1-0,RXLACM7-0 =
binary00 00000001
RXLDCL1-0,RXLDCM7-0 =
binary 01 00001001
Y0D-Y0F
YF0
Interrupts and IO
Control
All interrupts are suspended and
CSTO and DSTo enables are off
Tx8KEN,RXDO,TXMFSEL,
SPND,INTA,DSToEN,CSToEN,RxCO,C
NTCLR,SAMPLE,RST = 0
YF1
Latched Status
All latched status bits are cleared
Y10-Y2F
Per Channel
Control
Per Channel inversion, Remote
timeslot loopback, local timeslot
loopback,transmit test, receive test,
Clear channel, Receive freeze,
transmit freeze are all turned off
RPCI,MPDR,MPST,TCPI,RTSL,LTSL,TT
ST,RRST,MPDT,CC=0
Y90-YAF
Interrupts Masks
and status
Registers
All interrupts are unmasked.
Receive Sync and Alarm status & Mask,
Counter statusMask, Receive Line Status
Mask, Elastic store status mask and
HDLC Status Mask = 0
Y43 TO
Y46
Function
Status
Control Bits Reset Value
Register
Address
Table 36 - Reset Status (T1)
相關PDF資料 |
PDF描述 |
|---|---|
| MT90820 | Large Digital Switch |
| MT90820AL | Large Digital Switch |
| MT90820AL1 | Large Digital Switch |
| MT90823AL1 | 3V Large Digital Switch |
| MT90823 | 3V Large Digital Switch |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MT9072AV2 | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays |
| MT90732 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
| MT90732AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
| MT90733 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS DS3 Framer (DS3F) |
| MT90733AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS DS3 Framer (DS3F) |
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