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參數(shù)資料
| 型號： | MT4LC16M4T8TG-6S |
| 廠商： | Micron Technology, Inc. |
| 英文描述： | DRAM |
| 中文描述： | 內(nèi)存 |
| 文件頁數(shù)： | 18/20頁 |
| 文件大?。?/td> | 350K |
| 代理商： | MT4LC16M4T8TG-6S |
18
16 Meg x 4 FPM DRAM
D21_2.p65 – Rev. 5/00
Micron Technology, Inc., reserves the right to change products or specifications without notice.
2000, Micron Technology, Inc.
16 MEG x 4
FPM DRAM
SELF REFRESH CYCLE
(Addresses and OE# = DON’T CARE)
V
IL
RAS#
tRASS
OPEN
V
IL
V
OL
DQ
tRPC
tCHD
tRPS
tRPC
tRP
tCP
CAS#
WE#
V
IL
tWRH
tWRP
tWRH
tWRP
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
(
)
NOTE 1
tCSR
DON’T CARE
UNDEFINED
tCP
NOTE 2
(
)
(
)
(
)
(
)
NOTE:
1. Once
t
RASS (MIN) is met and RAS# remains LOW, the DRAM will enter self refresh mode.
2. Once
t
RPS is satisfied, a complete burst of all rows should be executed, if RAS#-only or burst CBR refresh is used.
-5
-6
SYMBOL
t
RPC
t
RPS
t
WRH
t
WRP
MIN
0
90
10
10
MAX
MIN
0
105
10
10
MAX
UNITS
ns
ns
ns
ns
TIMING PARAMETERS
-5
-6
SYMBOL
t
CHD
t
CP
t
CSR
t
RASS
t
RP
MIN
15
8
5
100
30
MAX
MIN
15
10
5
100
40
MAX
UNITS
ns
ns
ns
μs
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT4LC4M16F5 | DRAM |
| MT4LC4M16R6 | DRAM |
| MT4LC8M8E1TG-5 | DRAM |
| MT4LC8M8E1TG-5S | PLUG, LOW PROFILE 3 POLE |
| MT4LC8M8P4DJ-5 | DRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT4LC1M16C3DJ-6 | 制造商:MICRON 制造商全稱:Micron Technology 功能描述:FPM DRAM |
| MT4LC1M16C3DJ-6S | 制造商:MICRON 制造商全稱:Micron Technology 功能描述:FPM DRAM |
| MT4LC1M16C3TG6 | 制造商:Micron Technology Inc 功能描述: |
| MT4LC1M16C3TG-6 | 制造商:MICRON 制造商全稱:Micron Technology 功能描述:FPM DRAM |
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