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參數(shù)資料
| 型號： | MT4C4M4Ax |
| 廠商： | Micron Technology, Inc. |
| 英文描述： | DRAM |
| 中文描述： | 內(nèi)存 |
| 文件頁數(shù)： | 18/20頁 |
| 文件大?。?/td> | 360K |
| 代理商： | MT4C4M4AX |
18
4 Meg x 4 FPM DRAM
D49_5V.p65 – Rev. 5/00
Micron Technology, Inc., reserves the right to change products or specifications without notice.
2000, Micron Technology, Inc.
4 MEG x 4
FPM DRAM
SELF REFRESH CYCLE
(Addresses and OE# = DON’T CARE)
tRP
V
IL
RAS#
tRAS
OPEN
tCHR
tCSR
V
IL
CAS#
Q
tRP
tRAS
tRPC
tCSR
tRPC
tCHR
tCP
V
IL
tWRP
tWRH
tWRP
tWRH
WE#
DON’T CARE
UNDEFINED
NOTE:
1. Once
t
RASS (MIN) is met and RAS# remains LOW, the DRAM will enter self refresh mode.
2. Once
t
RPS is satisfied, a complete burst of all rows should be executed if RAS#-only or burst CBR refresh is used.
-5
-6
SYMBOL
t
RPC
t
RPS
t
WRH
t
WRP
MIN
5
90
8
8
MAX
MIN
5
105
10
10
MAX
UNITS
ns
ns
ns
ns
TIMING PARAMETERS
-5
-6
SYMBOL
t
CHD
t
CP
t
CSR
t
RASS
t
RP
MIN
15
8
5
100
30
MAX
MIN
15
10
5
100
40
MAX
UNITS
ns
ns
ns
μs
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT4LC4M4B1TG-6 | DRAM |
| MT4LC4M4A1TG-6 | DRAM |
| MT4C4M4B1TG-6 | DRAM |
| MT4C4M4A1TG-6 | DRAM |
| MT4LC4M4E8TGS | 4 MEG x 4 EDO DRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT4C4M4B1 | 制造商:MICRON 制造商全稱:Micron Technology 功能描述:DRAM |
| MT4C4M4B1DJ-6 | 制造商:MICRON 制造商全稱:Micron Technology 功能描述:DRAM |
| MT4C4M4B1DJ-6S | 制造商:MICRON 制造商全稱:Micron Technology 功能描述:DRAM |
| MT4C4M4B1TG-6 | 制造商:MICRON 制造商全稱:Micron Technology 功能描述:DRAM |
| MT4C4M4B1TG-6S | 制造商:MICRON 制造商全稱:Micron Technology 功能描述:DRAM |
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