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參數(shù)資料
| 型號： | MPC961PACR2 |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 1/13頁 |
| 文件大小： | 0K |
| 描述： | IC BUFFER ZD 1:18 PLL 32-LQFP |
| 標準包裝： | 2,000 |
| 類型： | 零延遲緩沖器 |
| PLL： | 是 |
| 輸入： | LVPECL |
| 輸出： | LVCMOS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:17 |
| 差分 - 輸入:輸出： | 是/無 |
| 頻率 - 最大： | 200MHz |
| 除法器/乘法器： | 無/無 |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-TQFP（7x7） |
| 包裝： | 帶卷 (TR) |
DATASHEET
Low Voltage Zero Delay Buffer
MPC961P
NRND
MPC961P REVISION 5 JANUARY 8, 2013
1
2013 Integrated Device Technology, Inc.
The MPC961 is a 2.5 V or 3.3 V compatible, 1:18 PLL based zero delay buffer.
With output frequencies of up to 200 MHz, output skews of 150 ps the device
meets the needs of the most demanding clock tree applications.
Features
Fully Integrated PLL
Up to 200 MHz I/O Frequency
LVCMOS Outputs
Outputs Disable in High Impedance
LVPECL Reference Clock Options
LQFP Packaging
32-lead Pb-free Package Available
50 ps Cycle-Cycle Jitter
150 ps Output Skews
Not Recommend for New Designs
Functional Description
The MPC961 is offered with two different input configurations. The MPC961P
offers an LVCMOS reference clock while the MPC961P offers an LVPECL
reference clock.
When pulled high the OE pin will force all of the outputs (except QFB) into a
high impedance state. Because the OE pin does not affect the QFB output, down
stream clocks can be disabled without the internal PLL losing lock.
The MPC961 is fully 2.5 V or 3.3 V compatible and requires no external loop
filter components. All control inputs accept
LVCMOS compatible levels and the outputs provide low impedance LVCMOS
outputs capable of driving terminated 50
transmission lines. For series termi-
nated lines the MPC961 can drive two lines per output giving the device an ef-
fective fanout of 1:36. The device is packaged in a 32 lead LQFP package to
provide the optimum combination of board density and performance.
MPC961P
LOW VOLTAGE
ZERO DELAY BUFFER
FA SUFFIX
32-LEAD LQFP PACKAGE
CASE 873A-03
AC SUFFIX
32-LEAD LQFP PACKAGE
Pb-FREE PACKAGE
CASE 873A-03
PCLK
FB_IN
Q0
Q14
QFB
0
PLL
1
F_RANGE
OE
Q1
Q2
Q3
Q15
Q16
Ref
FB
100 – 200 MHz
50 – 100 MHz
The MPC961P requires an external RC filter for the analog power supply pin VCCA. Refer to APPLICATIONS INFORMATION for details.
50 k
PCLK
50 k
VCC
NRND – Not Recommend for New Designs
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| LTC1661CN8#PBF | IC D/A CONV 10BIT MICRPWR 8-DIP |
| VE-B0Y-MX-F3 | CONVERTER MOD DC/DC 3.3V 49.5W |
| VE-B0Y-MX-F2 | CONVERTER MOD DC/DC 3.3V 49.5W |
| VE-B0X-MY-F4 | CONVERTER MOD DC/DC 5.2V 50W |
| VE-B0X-MY-F3 | CONVERTER MOD DC/DC 5.2V 50W |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MPC962305D-1HR2 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Low-Cost 3.3 V Zero Delay Buffer |
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