參數(shù)資料
型號： MPC8544CVTAQJB
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 1000 MHz, RISC PROCESSOR, PBGA783
封裝： 29 X 29 MM, 1 MM PITCH, LEAD FREE, PLASTIC, BGA-783
文件頁數(shù)： 43/120頁
文件大?。?/td> 1321K
代理商： MPC8544CVTAQJB
MPC8544E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 2
Freescale Semiconductor
29
Enhanced Three-Speed Ethernet (eTSEC), MII Management
8.4.1
SGMII Transmit AC Timing Specifications
Table 26 provides the SGMII transmit AC timing targets. A source synchronous clock is not provided.
8.4.2
SGMII Receive AC Timing Specifications
Table 27 provides the SGMII receive AC timing specifications. Source synchronous clocking is not
supported. Clock is recovered from the data. Figure 9 shows the SGMII receiver input compliance mask
eye diagram.
Table 26. SGMII Transmit AC Timing Specifications
At recommended operating conditions with XVDD_SRDS2 = 1.0 V ± 5%.
Parameter
Symbol
Min
Typ
Max
Unit
Notes
Deterministic jitter
JD
—
0.17
UI p-p
—
Total jitter
JT
—
0.35
UI p-p
—
Unit interval
UI
799.92
800
800.08
ps
2
VOD fall time (80%–20%)
tfall
50
—
120
ps
—
VOD rise time (20%–80%)
trise
50
—
120
ps
—
Notes;
1. Source synchronous clock is not supported.
2. Each UI value is 800 ps ± 100 ppm.
Table 27. SGMII Receiver AC Timing Specifications
At recommended operating conditions with XVDD_SRDS2 = 1.0 V ± 5%.
Parameter
Symbol
Min
Typ
Max
Unit
Notes
Deterministic jitter tolerance
JD
0.37
—
UI p-p
1
Combined deterministic and random jitter
tolerance
JDR
0.55
—
UI p-p
1
Sinusoidal jitter tolerance
Jsin
0.1
—
UI p-p
1
Total jitter tolerance
JT
0.65
—
UI p-p
1
Bit error ratio
BER
—
10-12
——
Unit interval
UI
799.92
800
800.08
ps
2
AC coupling capacitor
CTX
5—
200
nF
3
Notes:
1. Measured at receiver.
2. Each UI value is 800 ps ± 100 ppm.
3. The external AC coupling capacitor is required. It’s recommended to be placed near the device transmitter outputs.
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