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參數(shù)資料
| 型號(hào)： | MPC8360EZUALFHA |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 20/102頁(yè) |
| 文件大小： | 0K |
| 描述： | IC MPU POWERQUICC II PRO 740TBGA |
| 標(biāo)準(zhǔn)包裝： | 21 |
| 系列： | MPC83xx |
| 處理器類(lèi)型： | 32-位 MPC83xx PowerQUICC II Pro |
| 速度： | 667MHz |
| 電壓： | 1.3V |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 740-LBGA |
| 供應(yīng)商設(shè)備封裝： | 740-TBGA（37.5x37.5） |
| 包裝： | 托盤(pán) |
| 配用： | MPC8360EA-MDS-PB-ND - KIT APPLICATION DEV 8360 SYSTEM MPC8360E-RDK-ND - BOARD REFERENCE DESIGN FOR MPC |
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MPC8360E/MPC8358E PowerQUICC II Pro Processor Revision 2.x TBGA Silicon Hardware Specifications, Rev. 5
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Freescale Semiconductor
DDR and DDR2 SDRAM AC Electrical Characteristics
This figure provides the AC test load for the DDR bus.
Figure 8. DDR AC Test Load
This figure shows the DDR SDRAM output timing diagram for source synchronous mode.
Figure 9. DDR SDRAM Output Timing Diagram for Source Synchronous Mode
Table 22. DDR and DDR2 SDRAM Measurement Conditions
Symbol
DDR
DDR2
Unit
Notes
VTH
MVREF ± 0.31 V
MVREF ± 0.25 V
V
1
VOUT
0.5
× GVDD
0.5
× GVDD
V
2
Notes:
1. Data input threshold measurement point.
2. Data output measurement point.
Output
Z0 = 50 Ω
GVDD/2
RL = 50 Ω
ADDR/CMD
tDDKHAS, tDDKHCS
tDDKHMH
tDDKLDS
tDDKHDS
MDQ[x]
MDQS[n]
MCK[n]
tMCK
tDDKLDX
tDDKHDX
D1
D0
Write A0
NOOP
tDDKHME
tDDKHMP
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