參數(shù)資料
型號(hào)： MPC8308CVMAFD
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 83/83頁(yè)
文件大小： 0K
描述： MPU POWERQUICC II PRO 473MAPBGA
產(chǎn)品培訓(xùn)模塊： MPC8308 PowerQUICC II Pro Processor
特色產(chǎn)品： MPC8308 PowerQUICC? II Pro Processor
標(biāo)準(zhǔn)包裝： 84
系列： MPC83xx
處理器類型： 32-位 MPC83xx PowerQUICC II Pro
速度： 333MHz
電壓： 1V
安裝類型： 表面貼裝
封裝/外殼： 473-LFBGA
供應(yīng)商設(shè)備封裝： 473-MAPBGA（19x19）
包裝： 托盤
MPC8308 PowerQUICC II Pro Processor Hardware Specification, Rev. 3
Freescale Semiconductor
9
RESET Initialization
5.2
RESET AC Electrical Characteristics
This table provides the reset initialization AC timing specifications.
This table provides the PLL lock times.
Table 11. RESET Initialization Timing Specifications
Parameter/Condition
Min
Max
Unit
Notes
Required assertion time of HRESET (input) to activate reset flow
32
—
tSYS_CLK_IN
1
Required assertion time of PORESET with stable power and clock applied to
SYS_CLK_IN
32
—
tSYS_CLK_IN
—
HRESET assertion (output)
512
—
tSYS_CLK_IN
1
Input setup time for POR configuration signals (CFG_RESET_SOURCE[0:3]) with
respect to negation of PORESET
4—
tSYS_CLK_IN
—
Input hold time for POR configuration signals with respect to negation of HRESET
0—
ns
—
Time for the device to turn off POR configuration signal drivers with respect to the
assertion of HRESET
—4
ns
2
Time for the device to turn on POR configuration signal drivers with respect to the
negation of HRESET
1—
ns
1, 2
Notes:
1. tSYS_CLK_IN is the clock period of the input clock applied to SYS_CLK_IN.
2. POR configuration signals consists of CFG_RESET_SOURCE[0:3].
Table 12. PLL Lock Times
Parameter/Condition
Min
Max
Unit
Note
System PLL lock time
—
100
s—
e300 core PLL lock time
—
100
s—
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PDF描述
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MPC8308CVMAGD 功能描述:微處理器 - MPU E300 EXT TMP 400 RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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