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參數(shù)資料
| 型號： | MPC5606SCLQ6R |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 64 MHz, MICROCONTROLLER, PQFP144 |
| 封裝： | 20 X 20 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, LQFP-144 |
| 文件頁數(shù)： | 12/136頁 |
| 文件大?。?/td> | 858K |
| 代理商： | MPC5606SCLQ6R |
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MPC5606S Microcontroller Data Sheet, Rev. 7
Freescale Semiconductor
109
Figure 34. TFT LCD interface timing parameters
3.20.4
External Interrupt (IRQ) and Non-Maskable Interrupt (NMI) timing
Table 58. TFT LCD interface timing parameters1,2,3,4
1 The characteristics in this table are based on the assumption that data is output at positive edge and displays latch
data on negative edge
2 Intra bit skew is less than 2 ns
3 Load C
L = 50 pF for panel frequency up to 20 MHz
4 Load C
L = 25 pF for panel frequency from 20 to 32 MHz
Symbol
C
Parameter
Value
Unit
Min
Typ
Max
tCKP
CC
D PDI clock period
15.25
—
ns
CK
CC
D PDI clock duty cycle
40
—
60
%
tDSU
CC
D PDI data setup time
9.5
—
ns
tDHD
CC
D PDI data access hold time
4.5
—
ns
tCSU
CC
D PDI control signal setup time
9.5
—
ns
tCHD
CC
D PDI control signal hold time
4.5
—
ns
CC
D TFT interface data valid after pixel clock
—
6
ns
CC
D TFT interface VSYNC valid after pixel clock
—
5.5
ns
CC
D TFT interface DE valid after pixel clock
—
5.6
ns
CC
D TFT interface hold time for data and control bits
2
—
ns
CC
D Relative skew between the data bits
—
3.7
ns
DCU_HSYNC
DCU_VSYNC
DCU_DE
DCU_CLK
DCU_LD[23:0]
tCKH
tCKL
tCHD
tCSU
tDHD
tDSU
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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