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參數(shù)資料
| 型號： | MC68HSC05J1A |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 47/128頁 |
| 文件大小： | 1620K |
| 代理商： | MC68HSC05J1A |
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Interrupts
Interrupt Processing
MC68HC05J1A — Rev. 3.0
Technical Data
MOTOROLA
Interrupts
47
Figure 4-3. Stacking Order
Table 4-1
summarizes the reset and interrupt sources and vector
assignments.
Table 4-1. Reset/Interrupt Vector Addresses
Function
Source
Local
Mask
Global
Mask
Priority
(1 = Highest)
Vector Address
Reset
Power-on
RESET pin
COP watchdog
(1)
illegal address
1. The COP watchdog is a mask option.
2. Port A external interrupt capability is a mask option.
None
None
None
None
None
1
1
1
1
$07FE–$07FF
Software
interrupt
(SWI)
User code
None
None
Same priority
as instruction
$07FC–$07FD
External
interrupt
IRQ pin
PA3 pin
(2)
PA2 pin
(2)
PA1 pin
(2)
PA0 pin
(2)
IRQE bit
I bit
2
$07FA–$07FB
Timer
interrupts
TOF bit
RTIF bit
TOFE bit
RTIE bit
I bit
3
$07F8–$07F9
CONDITION CODE REGISTER
$00C0 (BOTTOM OF STACK)
$00C1
$00C2
ACCUMULATOR
INDEX REGISTER
PROGRAM COUNTER (HIGH BYTE)
PROGRAMCOUNTER (LOW BYTE)
$00FD
$00FE
$00FF (TOP OF STACK)
1
2
3
4
5
5
4
3
2
1
UNSTACKING
ORDER
STACKING
ORDER
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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