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參數(shù)資料
| 型號： | MAX9888EWY+T |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 64/115頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CODEC AUDIO FLEXSOUND 63WLP |
| 產品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 2,500 |
| 系列： | DirectDrive®, FLEXSOUND™ |
| 類型： | D 類 |
| 輸出類型： | 3 通道，帶立體聲耳機 |
| 在某負載時最大輸出功率 x 通道數(shù)量： | 1.37W x 2 @ 8 歐姆; 40mW x 2 @ 16 歐姆 |
| 電源電壓： | 2.8 V ~ 5.5 V |
| 特點： | 消除爆音，差分輸入，I²S，麥克風，靜音，關機 |
| 安裝類型： | 表面貼裝 |
| 供應商設備封裝： | 63-WLP |
| 封裝/外殼： | 63-WFBGA，WLCSP |
| 包裝： | 帶卷 (TR) |
| 配用： | MAX9888EVKIT+-ND - KIT EVALUATION FOR MAX9888 |
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Stereo Audio CODEC
with FlexSound Technology
MAX9888
52
Pin Description (continued)
PIN
NAME
FUNCTION
E1
DVDDS1
S1 Digital Audio Interface Power-Supply Input. Bypass to DGND with a 1FF capacitor.
E2
MCLK
Master Clock Input. Acceptable input frequency range is 10MHz to 60MHz.
E4
SDOUTS1
S1 Digital Audio Serial-Data ADC Output. The output voltage is referenced to DVDDS1.
E5
IRQ
Hardware Interrupt Output. IRQ can be programmed to pull low when bits in status register 0x00
change state. Read status register 0x00 to clear IRQ once set. Repeat faults have no effect on IRQ
until it is cleared by reading the I2C status register 0x00. Connect a 10kI pullup resistor to DVDD for
full output swing.
E8
MIC1P/
DIGMICDATA
Positive Differential Microphone 1 Input. AC-couple a microphone with a series 1FF capacitor. Can
be retasked as a digital microphone data input.
E9
INA1/
EXTMICP
Single-Ended Line Input A1. Also negative differential line input A or positive differential external
microphone input.
F1
DGND
Digital Ground
F2
BCLKS2
S2 Digital Audio Bit Clock Input/Output. BCLKS2 is an input when the IC is in slave mode and an
output when in master mode. The input/output voltage is referenced to DVDDS2.
F3
LRCLKS2
S2 Digital Audio Left-Right Clock Input/Output. LRCLKS2 is the audio sample rate clock and
determines whether audio data on S2 is routed to the left or right channel. In TDM mode, LRCLKS2 is
a frame sync pulse. LRCLKS2 is an input when the IC is in slave mode and an output when in master
mode. The input/output voltage is referenced to DVDDS2.
F4
SDA
I2C Serial-Data Input/Output. Connect a pullup resistor to DVDD for full output swing.
F5
SCL
I2C Serial-Clock Input
F6
REG
Common-Mode Voltage Reference. Bypass to AGND with a 1FF capacitor.
F7
REF
Converter Reference. Bypass to AGND with a 2.2FF capacitor.
F8
MIC1N/
DIGMICCLK
Negative Differential Microphone 1 Input. AC-couple a microphone with a series 1FF capacitor. Can
be retasked as a digital microphone clock output.
F9
MIC2P
Positive Differential Microphone 2 Input. AC-couple a microphone with a series 1FF capacitor.
G1
SDOUTS2
S2 Digital Audio Serial-Data ADC Output. The output voltage is referenced to DVDDS2.
G2
DVDDS2
S2 Digital Audio Interface Power-Supply Input. Bypass to DGND with a 1FF capacitor.
G3
SDINS2
S2 Digital Audio Serial-Data DAC Input. The input voltage is referenced to DVDDS2.
G4
DVDD
Digital Power Supply. Supply for the digital core and I2C interface. Bypass to DGND with a 1FF
capacitor.
G5
AVDD
Analog Power Supply. Bypass to AGND with a 1FF capacitor.
G6
PREG
Positive Internal Regulated Supply. Bypass to AGND with a 1FF capacitor.
G7
AGND
Analog Ground
G8
MICBIAS
Low-Noise Bias Voltage. Outputs a 2.2V microphone bias. An external resistor in the 2.2kI to 1kI
range should be used to set the microphone current.
G9
MIC2N
Negative Differential Microphone 2 Input. AC-couple a microphone with a series 1FF capacitor.
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PDF描述 |
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參數(shù)描述 |
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