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參數(shù)資料
| 型號(hào)： | MAX3886ETN+T |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 4/17頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MULTIRATE CDR SER/DES56-TQFN |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 類型： | 時(shí)鐘和數(shù)據(jù)恢復(fù)（CDR），多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 光纖網(wǎng)絡(luò)終端（ONT）應(yīng)用，千兆位無源光纖網(wǎng)絡(luò)（GPON），寬帶無源光纖網(wǎng)絡(luò)（BPON） |
| 輸入： | CML，LVDS，LVPECL |
| 輸出： | CML，LVDS |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 7:6 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 622MHz，2488Mbps |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 56-WFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 56-TQFN-EP（8x8） |
| 包裝： | 帶卷 (TR) |
MAX3886
Applications Information
Interfacing to the CDR/SerDes
The MAX3886 has CML, LVDS, and LVCMOS inputs
and outputs. The high-speed CML (LVPECL-compati-
ble) inputs, SDI±, are biased to VCC - 1.3V with an on-
chip high-impedance network (Figure 5). Figures 6 and
7 provide examples of DC-coupled and AC-coupled
termination networks that can be used to connect the
limiting amplifier outputs (CML or LVPECL) to the SDI±
inputs. The two high-speed CML outputs, SDO± and
BENO±, have internal 50
Ω back terminations to VCC
(Figure 8) and should be terminated with 50
Ω to VCC or
100
Ω differential at the laser driver inputs (Figure 9).
The burst SDO and BENO outputs must be DC-coupled
to the laser driver for proper operation. SDO can be
AC-coupled if a continuous serial signal is provided
between bursts (with gating provided by the laser dri-
ver BEN input).
The LVDS outputs (PDO[3:0]±, PCKO±, RCKO±)
require 100
Ω differential termination for proper opera-
tion. The LVDS inputs (PDI[3:0]±, PCKI±) are internally
terminated with 100
Ω differential resistance, eliminating
the need for external termination when connected to an
LVDS output (Figure 10).
Equivalent circuits for the three-state input (MVCO),
LVCMOS inputs (MSYM, MDDR, FRST), and LVCMOS
outputs (LOCK, FERR) are given in Figure 11, Figure 12,
and Figure 13. For more information on interfacing to
Maxim’s high-speed I/O circuits, refer to Application
Note HFAN-01.0:
Introduction to LVDS, PECL, and CML.
Multirate CDR with Integrated Serializer/Deserializer
for GPON and BPON ONT Applications
12
______________________________________________________________________________________
MAX3886
VCC
5k
Ω
16k
Ω
24k
Ω
SDI+
VCC
5k
Ω
SDI-
VCC
Figure 5. CML (LVPECL-Compatible) Input
100
Ω
CML
MAX3886
SDI+
DC-COUPLED
LIMITING AMPLIFIER
Z0 = 50
Ω
SDI-
Z0 = 50
Ω
100
Ω
CML
MAX3886
SDI+
AC-COUPLED
0.1
μF
LIMITING AMPLIFIER
Z0 = 50
Ω
SDI-
Z0 = 50
Ω
0.1
μF
Figure 6. Interface to Limiting Amplifier (CML Outputs)
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