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參數(shù)資料
| 型號： | MAX19700ETM+T |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 9/32頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC ANLG FRNT END 48-TQFN |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 2,500 |
| 位數(shù)： | 10 |
| 通道數(shù)： | 2 |
| 功率（瓦特）： | 36.3mW |
| 電壓 - 電源，模擬： | 3V |
| 電壓 - 電源，數(shù)字： | 3V |
| 封裝/外殼： | 48-WFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 48-TQFN-EP（7x7） |
| 包裝： | 帶卷 (TR) |
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MAX19700
7.5Msps, Ultra-Low-Power
Analog Front-End
______________________________________________________________________________________
17
Buffer amplifiers follow the TD-SCDMA filters. The
amplifier outputs are biased at an adjustable common-
mode DC level and designed to drive a differential input
stage with input impedance ≥70k. This simplifies the
analog interface between RF quadrature upconverters
and the MAX19700. Many RF upconverters require a
0.9V to 1.5V common-mode bias. The SPI-controlled
DC common-mode bias eliminates discrete level-setting
resistors and code-generated level shifting while pre-
serving the full dynamic range of each Tx DAC. Table 2
shows the Tx path output voltage vs. input codes. Table
10 shows the selection of DC common-mode levels.
The buffer amplifiers also feature a programmable full-
scale output level of ±410mV or ±500mV and indepen-
dent DC offset correction of each I/Q channel. Both
features are configured through the SPI interface. The
DC offset correction is used to optimize sideband and
carrier suppression in the Tx signal path (see Tables 8
and 9).
Figure 3. Rx ADC System Timing Diagram
tDOQ
tCL
tCH
tCLK
tDOI
tDR
5 CLOCK-CYCLE LATENCY (CHI)
5.5 CLOCK-CYCLE LATENCY (CHQ)
DR
CHQ
D0–D9
D0Q
CHI
D1I
CHQ
D1Q
CHI
D2I
CHQ
D2Q
CHI
D3I
CHQ
D3Q
CHI
D4I
CHQ
D4Q
CHI
D5I
CHQ
D5Q
CHI
D6I
CHQ
D6Q
CHI
CHQ
CLK
Figure 4. TD-SCDMA Filter Frequency Response
0.8
CHANNEL EDGE
4.32
IMAGE
1.27
fC
5.12
fCLK
FREQ (MHz)
NOT TO SCALE
Tx PATH:
SFDR = 76.5dBc
THD = -74.8dBc
SINAD = 57.1dB
-49.3dB
-15dB
-3dB
0dB
-55dB (min)
-57.1dB
OCCUPIED
CHANNEL
AMPLITUDE
TD-SCDMA
FILTER RESPONSE
DAC sin(x)/x
RESPONSE
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MAX19705ETM+ | IC ANLG FRNT END 48-TQFN |
| MAX19706ETM+T | IC ANLG FRNT END 48-TQFN |
| MAX19707ETM+T | IC ANLG FRNT END 48-TQFN |
| MAX19708ETM+ | IC ANLG FRONT END 11MSPS 48-TQFN |
| MAX19710ETN+T | IC ANLG FRNT END 56-TQFN |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MAX19700EVCMOD2 | 功能描述:ADC / DAC多通道 Evaluation Kit/Evaluation System for the MAX19700 RoHS:否 制造商:Texas Instruments 轉(zhuǎn)換速率: 分辨率:8 bit 接口類型:SPI 電壓參考: 電源電壓-最大:3.6 V 電源電壓-最小:2 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-40 |
| MAX19700EVKIT | 功能描述:數(shù)據(jù)轉(zhuǎn)換 IC 開發(fā)工具 RoHS:否 制造商:Texas Instruments 產(chǎn)品:Demonstration Kits 類型:ADC 工具用于評估:ADS130E08 接口類型:SPI 工作電源電壓:- 6 V to + 6 V |
| MAX19705ETM | 功能描述:ADC / DAC多通道 RoHS:否 制造商:Texas Instruments 轉(zhuǎn)換速率: 分辨率:8 bit 接口類型:SPI 電壓參考: 電源電壓-最大:3.6 V 電源電壓-最小:2 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-40 |
| MAX19705ETM+ | 功能描述:ADC / DAC多通道 7.5Msps CODEC/AFE 1.8/2.7-3.3V RoHS:否 制造商:Texas Instruments 轉(zhuǎn)換速率: 分辨率:8 bit 接口類型:SPI 電壓參考: 電源電壓-最大:3.6 V 電源電壓-最小:2 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-40 |
| MAX19705ETM+GH7 | 功能描述:ADC / DAC多通道 10-Bit 7.5Msps Ultra-Low-Power Analog Front-End RoHS:否 制造商:Texas Instruments 轉(zhuǎn)換速率: 分辨率:8 bit 接口類型:SPI 電壓參考: 電源電壓-最大:3.6 V 電源電壓-最小:2 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:VQFN-40 |
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