參數(shù)資料
型號： MAX1434ECQ+D
廠商： Maxim Integrated Products
文件頁數(shù)： 16/22頁
文件大小： 0K
描述： IC ADC 10BIT 50MSPS 100-TQFP
標(biāo)準(zhǔn)包裝： 90
位數(shù)： 10
采樣率（每秒）： 50M
數(shù)據(jù)接口： LVDS，串行
轉(zhuǎn)換器數(shù)目： 8
功率耗散（最大）： 882mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： *
封裝/外殼： 100-TQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 100-TQFP（14x14）
包裝： 托盤
輸入數(shù)目和類型： 8 個差分
MAX1434
Octal, 10-Bit, 50Msps, 1.8V ADC
with Serial LVDS Outputs
_______________________________________________________________________________________
3
ELECTRICAL CHARACTERISTICS (continued)
(VAVDD = 1.8V, VOVDD = 1.8V, VCVDD = 3.3V, VGND = 0V, external VREFIO = 1.24V, CREFIO = 0.1F, CREFP = 10F, CREFN = 10F,
fCLK = 50MHz (50% duty cycle), VDT = 0V, TA = TMIN to TMAX, unless otherwise noted. Typical values are at TA = +25°C.) (Notes 2, 3)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
fIN = 5.3MHz at -0.5dBFS
9.9
Effective Number of Bits
ENOB
fIN = 19.3MHz at -0.5dBFS
9.9
dB
fIN = 5.3MHz at -0.5dBFS
84
Spurious-Free Dynamic Range
SFDR
fIN = 19.3MHz at -0.5dBFS
77
85
dBc
fIN = 5.3MHz at -0.5dBFS
-89
Total Harmonic Distortion
THD
fIN = 19.3MHz at -0.5dBFS
-91
-77
dBc
Intermodulation Distortion
IMD
f1 = 5.3MHz at -6.5dBFS
f2 = 6.3MHz at -6.5dBFS
86.0
dBc
Third-Order Intermodulation
IM3
f1 = 5.3MHz at -6.5dBFS
f2 = 6.3MHz at -6.5dBFS
92.9
dBc
Aperture Jitter
tAJ
Figure 11
< 0.4
psRMS
Aperture Delay
tAD
Figure 11
1
ns
Small-Signal Bandwidth
SSBW
Input at -20dBFS
100
MHz
Full-Power Bandwidth
LSBW
Input at -0.5dBFS
100
MHz
Output Noise
IN_P = IN_N
0.058
LSBRMS
Over-Range Recovery Time
tOR
RS = 25
, CS = 50pF
1
Clock
cycle
INTERNAL REFERENCE
REFADJ Internal Reference-Mode
Enable Voltage
(Note 6)
0.1
V
REFADJ Low-Leakage Current
1.5
mA
REFIO Output Voltage
VREFIO
1.18
1.24
1.30
V
Reference Temperature
Coefficient
TCREFIO
120
ppm/°C
EXTERNAL REFERENCE
REFADJ External Reference-
Mode Enable Voltage
(Note 6)
VAVDD -
0.1
V
REFADJ High-Leakage Current
200
A
REFIO Input Voltage
1.24
V
REFIO Input Voltage Tolerance
±5
%
REFIO Input Current
IREFIO
<1
A
COMMON-MODE OUTPUT (CMOUT)
CMOUT Output Voltage
VCMOUT
0.76
V
CLOCK INPUT (CLK)
Input High Voltage
VCLKH
0.8 x
VAVDD
V
Input Low Voltage
VCLKL
0.2 x
VAVDD
V
Clock Duty Cycle
50
%
Clock Duty-Cycle Tolerance
±30
%
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PDF描述
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參數(shù)描述
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