參數(shù)資料
型號： M38039M4-XXXKP
廠商： Renesas Technology Corp.
英文描述： 9-Mbit (256K x 36/512K x 18) Flow-Through SRAM; Architecture: Standard Sync, Flow-through; Density: 9 Mb; Organization: 256Kb x 36; Vcc (V): 3.1 to 3.6 V
中文描述： 單芯片8位CMOS微機(jī)
文件頁數(shù)： 115/119頁
文件大小： 1575K
代理商： M38039M4-XXXKP
Rev.1.00
REJ03B0212-0100
Apr 2, 2007
Page 115 of 117
3803 Group (Spec.L)
Fig 101.Timing diagram (in single-chip mode)
t
C
(CNTR)
t
WL
(CNTR)
t
WH
(CNTR)
0.8V
CC
0.2V
CC
CNTR
0
, CNTR
1
CNTR
2
INT
1
, INT
2
, INT
3
INT
00
, INT
40
INT
01
, INT
41
RESET
X
IN
t
WL
(INT)
t
WH
(INT)
0.8V
CC
0.2V
CC
0.8V
CC
0.2V
CC
t
W
(RESET)
t
C
(X
IN
)
t
WL
(X
IN
)
t
WH
(X
IN
)
0.8V
CC
0.2V
CC
t
C
(S
CLK1
), t
C
(S
CLK2
), t
C
(S
CLK3
)
t
WL
(S
CLK1
), t
WL
(S
CLK2
), t
WL
(S
CLK3
)
0.8V
CC
0.2V
CC
0.2V
CC
t
WH
(S
CLK1
), t
WH
(S
CLK2
), t
WH
(S
CLK3
)
t
f
t
r
t
su
(R
X
D
1
-S
CLK1
),
t
su
(S
IN2
-S
CLK2
),
t
su
(R
X
D
3
-S
CLK3
)
t
h
(S
CLK1
-R
X
D
1
),
t
h
(S
CLK2
-S
IN2
),
t
h
(S
CLK3
-R
X
D
3
)
t
d
(S
CLK1
-T
X
D
1
), t
d
(S
CLK2
-S
OUT2
), t
d
(S
CLK3
-T
X
D
3
)
t
v
(S
CLK1
-T
X
D
1
),
t
v
(S
CLK2
-S
OUT2
),
t
v
(S
CLK3
-T
X
D
3
)
0.8V
CC
S
CLK1
S
CLK2
S
CLK3
R
X
D
1
R
X
D
3
S
IN2
T
X
D
1
T
X
D
3
S
OUT2
X
CIN
t
C
(X
CIN
)
t
WL
(X
CIN
)
t
WH
(X
CIN
)
0.8V
CC
0.2V
CC
Single-chip mode timing diagram
相關(guān)PDF資料
PDF描述
M38039M4-XXXSP SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER
M38039M4-XXXWG SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER
M38039M5L-XXXHP SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER
M38039M5L-XXXKP 9-Mbit (256K x 36/512K x 18) Pipelined SRAM; Architecture: Standard Sync, Pipeline SCD; Density: 9 Mb; Organization: 512Kb x 18; Vcc (V): 3.1 to 3.6 V
M38039M5L-XXXSP 9-Mbit (256K x 36/512K x 18) Flow-Through SRAM; Architecture: Standard Sync, Flow-through; Density: 9 Mb; Organization: 512Kb x 18; Vcc (V): 3.1 to 3.6 V
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