參數(shù)資料
型號(hào)： M37905M4C-XXXFP
元件分類： 微控制器/微處理器
英文描述： 16-BIT, MROM, 20 MHz, MICROCONTROLLER, PQFP64
封裝： 14 X 14 MM, 0.80 MM PITCH, PLASTIC, QFP-64
文件頁數(shù)： 207/565頁
文件大小： 3382K
代理商： M37905M4C-XXXFP
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SERIAL I/O
7905 Group User’s Manual Rev.1.0
11-30
11.3 Clock synchronous serial I/O mode
Fig. 11.3.8 Initial setting example for relevant registers when receiving
0
UART0 transmit/receive mode register (Address 3016)
UART1 transmit/receive mode register (Address 3816)
UART2 transmit/receive mode register (Address B016)
b7
b0
Internal/External clock select bit
0: Internal clock
1: External clock
: It may be either “0” or “1.”
Selection of clock synchronous serial
I/O mode
UART0 transmit/receive control register 0 (Address 3416)
UART1 transmit/receive control register 0 (Address 3C16)
UART2 transmit/receive control register 0 (Address B416)
b7
b0
BRG count source select bits
CTS/RTS function select bit
0: CTS function selected
1: RTS function selected
b1 b0
Reception starts.
UART0 transmit buffer register (Address 3216)
UART1 transmit buffer register (Address 3A16)
UART2 transmit buffer register (Address B216)
b7
b0
Dummy data is set.
1
UART0 transmit/receive control register 1 (Address 3516)
UART1 transmit/receive control register 1 (Address 3D16)
UART2 transmit/receive control register 1 (Address B516)
b7
b0
Transmit enable bit
1: Transmission enabled
UART0 baud rate register (BRG0) (Address 3116)
UART1 baud rate register (BRG1) (Address 3916)
UART2 baud rate register (BRG2) (Address B116)
b7
b0
Can be set to “0016” to “FF16”.
UART1 receive interrupt control register (Address 7416)
UART0 receive interrupt control register (Address 7216)
UART2 receive interrupt control register (Address F216)
b7
b0
Interrupt priority level select bits
When using interrupts, set these bits to
one of levels 1 to 7.
When disabling interrupts, set these bits
to level 0.
CTS/RTS enable bit
0: CTS/RTS function is enabled.
1: CTS/RTS function is disabled
CLK polarity select bit
0: At the rising edge of the transfer
clock, receive data is input.
1: At the falling edge of the transfer
clock, receive data is input.
Transfer format select bit
0: LSB first
1: MSB first
When external clock is selected.
When internal clock is selected.
UARTi receive interrupt mode select bit
0: Reception interrupt
1: Reception error interrupt
0
Port P8 direction register (Address 1416)
Port P1 direction register (Address 516)
b7
b0
Pin RxD0
Pin RxD1
Pin RxD2
0
1
Reception enable bit
1: Reception enabled
1
0
Serial I/O pin control register (Address AC16)
b7
b0
i
TxD0/P13 switch bit (Note 2)
0: Functions as TxD0.
1: Functions as P13.
TxD1/P17 switch bit (Note 2)
0: Functions as TxD1.
1: Functions as P17.
0: Functions as TxD2.
1: Functions as P83.
7
CTS1/RTS1 separate select bit
0: CTS1/RTS1 are used together (Note 1)
1
CTS0/RTS0 separate select bit
0: CTS0/RTS0 are used together (Note 1)
CTS2/RTS2 separate select bit
0: CTS2/RTS2 are used together (Note 1)
Notes 1: In the clock synchronous serial I/O
mode, CTSi/RTSi separation cannot
be selected. (Refer to section “[Pre-
cautions for clock synchronous
serial I/O mode].”)
2: When only reception is performed, if
these bits = “1,” the TxDi pin can be
used as a programmable I/O port
pin.
TxD2/P83 switch bit (Note 2)
3
0
b7
b0
Note: Set the receive enable bit
and the transmit enable
bit to “1” simultaneously.
0 0: f2
0 1: f16
1 0: f64
1 1: f512
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PDF描述
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