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參數(shù)資料
| 型號： | M37721S2BFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 15/576頁 |
| 文件大?。?/td> | 6745K |
| 代理商： | M37721S2BFP |
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7721 Group User’s Manual
INTERRUPTS
7–15
7.7.2 Push operation for registers
The push operation for registers performed in the INTACK sequence depends on whether the contents of
the stack pointer (S) at acceptance of an interrupt request are even or odd.
When the contents of the stack pointer (S) are even, the contents of the program counter (PC) and the
processor status register (PS) are simultaneously pushed in a unit of 16 bits. When the contents of the
stack pointer (S) are odd, each of these registers is pushed in a unit of 8 bits. Figure 7.7.3 shows the push
operation for registers.
In the INTACK sequence, only the contents of the program bank register (PG), program counter (PC), and
processor status register (PS) are pushed onto the stack area. The other necessary registers must be
pushed by software at the start of the interrupt routine.
By using the PSH instruction, all CPU registers except the stack pointer (S) can be pushed.
7.7 Sequence from acceptance of interrupt request until execution of interrupt routine
Fig. 7.7.3 Push operation for registers
Pushed in 3 times.
Pushed in a unit of 16 bits.
Pushed in a unit of 16 bits.
(1) When contents of stack pointer (S) are even
Low-order byte of processor status register (PSL)
Program bank register (PG)
Address
[S] – 4 (even)
[S] – 3 (odd)
[S] – 2 (even)
[S] – 1 (odd)
[S] (even)
Order for push
[S] – 5 (odd)
Address
[S] – 4 (odd)
[S] – 3 (even)
[S] – 2 (odd)
[S] – 1 (even)
[S] (odd)
Pushed in a unit of 8 bits.
Order for push
Pushed in 5 times.
[S] – 5 (even)
High-order byte of processor status register (PSH)
Low-order byte of program counter (PCL)
High-order byte of program counter (PCH)
(2) When contents of stack pointer (S) are odd
Low-order byte of processor status register (PSL)
Program bank register (PG)
High-order byte of processor status register (PSH)
Low-order byte of program counter (PCL)
High-order byte of program counter (PCH)
V [S] is an initial address that the stack pointer (S) indicates when an interrupt request is accepted.
The S’s contents become “[S] – 5” after all of the above registers are pushed.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| M37733EHBXXXFP | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:PROM VERSION OF M37733MHBXXXFP(MICROCOMPUTERS) |
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