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參數資料
| 型號： | M30280M6V-XXXHP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 20 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 0.50 MM PITCH, PLASTIC, LQFP-64 |
| 文件頁數： | 366/415頁 |
| 文件大小： | 2591K |
| 代理商： | M30280M6V-XXXHP |
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M16C/28 Group
Under development Preliminary specification
Specifications in this manual are tentative and subject to change.
7. Clock Generation Circuit
Rev.0.60 2004.02.01
page 36 of N
REJ09B0047-0060Z
Figure 7.6. PCLKR Register and PM2 Register
Function
Bit symbol
Bit name
Peripheral clock select register (Note)
Symbol
Address
When reset
PCLKR
025E16
000000112
RW
b7
b6
b5
b4
b3
b2
b1
b0
PCLK0
Timers A, B clock select bit
(Clock source for the
timers A, B, the timer S,
and the dead timer)
0 : f2
1 : f1
00 0
Reserved bit
Must set to
“0”
Note: Write to this register after setting the PRC0 bit of PRCR register to “1” (write enable).
00 0
PCLK1
SI/O clock select bit
(Clock source for UART0
to UART2, SI/O3, SI/O4)
0 : f2SIO
1 : f1SIO
RW
(b7-b2)
Function
Bit symbol
Bit name
Processeor mode register 2 (Note 1)
Symbol
Address
When reset
PM2
001E16
XXX000002
RW
b7
b6
b5
b4
b3
b2
b1
b0
PM20
Specifying wait when
accessing SFR during
PLL operation
0 : 2 wait
1 : 1 wait
00
Nothing is assigned. When write, set to “0”. When read,
its content is indeterminate.
PM21
System clock protective bit
0 : Clock is protected by PRCR
register
1 : Clock modification disabled
RW
(b7-b5)
PM22
PM24
(b3)
WDT count source
protective bit
Reserved bit
0 : CPU clock is used for the
watchdog timer count source
1 : Ring oscillator clock is used
for the watchdog timer count
source
Must set to “0”
P85/NMI configuration bit
RW
(Note 2)
(Note 3,4)
(Note 3,5)
(Note 6,7)
Note 1: Write to this register after setting the PRC1 bit of PRCR register to “1” (write enable).
Note 2: This bit can only be rewritten while the PLC07 bit is “0” (PLL turned off). Also, to select a 16MHz or
higher PLL clock or sytem clock, set this bit to “0” (2 wait).
Note 3: Once this bit is set to “1”, it cannot be cleared to “0” in a program.
Note 4: Setting the PM21 bit to “1” results in the following conditions:
The BCLK is not halted by executing the WAIT instruction.
Writting to the following bits has no effect.
CM02 bit of CM0 register
CM05 bit of CM0 register (main clock is not halted)
CM07 bit of CM0 register (CPU clock source does not change)
CM10 bit of CM1 register (stop mode is not entered)
CM11 bit of CM1 register (CPU clock source does not change)
CM20 bit of CM2 register (oscillation stop, re-oscillation detection function settings do not change)
All bit of PLC0 register (PLL frequency synthesizer setting do not change)
Note 5: Setting the PM22 bit to “1” results in the following conditions:
The ring oscillator starts oscillating, and the ring oscillator clock becomes the watchdog timer count source.
The CM10 bit of CM1 register is disabled against write. (Writing a “1” has no effect, nor is stop mode
entered.)
The watchdog timer does not stop when in wait mode.
Note 6: For NMI function, the PM24 bit must be set to “1”(NMI function) in first instruction after rest. Once this bit is
set to “1”, it cannot be cleared to “0” in a program. When the PM24 bit is set to “1”, the P85 direction register
must be “0”.
Note 7: SD input is valid regardless of the PM24 setting.
0 : P85 function (NMI disable)
1 : NMI function
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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