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參數(shù)資料
| 型號(hào)： | LA4064ZC-75TN100E |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁(yè)數(shù)： | 16/42頁(yè) |
| 文件大小： | 0K |
| 描述： | IC CPLD 64MACROCELLS 100TQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | LA-ispMACH |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時(shí)間 tpd(1)： | 7.5ns |
| 電壓電源 - 內(nèi)部： | 1.7 V ~ 1.9 V |
| 宏單元數(shù)： | 64 |
| 輸入/輸出數(shù)： | 64 |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應(yīng)商設(shè)備封裝： | 100-TQFP（14x14） |
| 包裝： | 托盤(pán) |
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Lattice Semiconductor
LA-ispMACH 4000V/Z Automotive Family Data Sheet
23
LA-ispMACH 4000V/Z Timing Adders
1
Adder Type
Base Parameter
Description
LA-ispMACH 4000V
-75
LA-ispMACH 4000Z
-75
Units
Min.
Max.
Min.
Max.
Optional Delay Adders
tINDIO
tINREG
Input register delay
—
1.00
—
1.30
ns
tEXP
tMCELL
Product term expander delay
—
0.33
—
0.50
ns
tORP
—
Output routing pool delay
—
0.05
—
0.40
ns
tBLA
tROUTE
Additional block loading adder
—
0.05
—
0.05
ns
tIOI Input Adjusters
LVTTL_in
tIN, tGCLK_IN, tGOE Using LVTTL standard
—
0.60
—
0.60
ns
LVCMOS33_in
tIN, tGCLK_IN, tGOE Using LVCMOS 3.3 standard
—
0.60
—
0.60
ns
LVCMOS25_in
tIN, tGCLK_IN, tGOE Using LVCMOS 2.5 standard
—
0.60
—
0.60
ns
LVCMOS18_in
tIN, tGCLK_IN, tGOE Using LVCMOS 1.8 standard
—
0.00
—
0.00
ns
PCI_in
tIN, tGCLK_IN, tGOE Using PCI compatible input
—
0.60
—
0.60
ns
tIOO Output Adjusters
LVTTL_out
tBUF, tEN, tDIS
Output congured as TTL buffer
—
0.20
—
0.20
ns
LVCMOS33_out tBUF, tEN, tDIS
Output congured as 3.3V buffer
—
0.20
—
0.20
ns
LVCMOS25_out tBUF, tEN, tDIS
Output congured as 2.5V buffer
—
0.10
—
0.10
ns
LVCMOS18_out tBUF, tEN, tDIS
Output congured as 1.8V buffer
—
0.00
—
0.00
ns
PCI_out
tBUF, tEN, tDIS
Output congured as PCI
compatible buffer
—
0.20
—
0.20
ns
Slow Slew
tBUF, tEN
Output congured for slow slew
rate
—
1.00
—
1.00
ns
Note: Open drain timing is the same as corresponding LVCMOS timing.
Timing v.3.2
1. Refer to TN1004, ispMACH 4000 Timing Model Design and Usage Guidelines for information regarding use of these adders.
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PDF描述 |
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參數(shù)描述 |
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| LA4064ZC-75TN128E | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:3.3V/1.8V In-System Programmable SuperFAST High Density PLDs |
| LA4064ZC-75TN144E | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:3.3V/1.8V In-System Programmable SuperFAST High Density PLDs |
| LA4064ZC-75TN44E | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:3.3V/1.8V In-System Programmable SuperFAST High Density PLDs |
| LA4064ZC-75TN48E | 功能描述:CPLD - 復(fù)雜可編程邏輯器件 Auto Grade (AEC-Q100 ) ispMACH4064Z RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| LA4064ZV-75TN100E | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:3.3V/1.8V In-System Programmable SuperFAST High Density PLDs |
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