參數(shù)資料
型號(hào)： ISP1161ABD
廠(chǎng)商： NXP SEMICONDUCTORS
元件分類(lèi)： 總線(xiàn)控制器
英文描述： Full-speed Universal Serial Bus single-chip host and device controller
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PQFP64
封裝： 10 X 10 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-314-2, LQFP-64
文件頁(yè)數(shù)： 75/134頁(yè)
文件大?。?/td> 587K
代理商： ISP1161ABD
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Philips Semiconductors
ISP1161A
Full-speed USB single-chip host and device controller
Product data
Rev. 03 — 23 December 2004
75 of 134
9397 750 13962
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
10.6.6
HcITLBufferPort register (R/W: 40H/C0H)
This is the ITL buffer RAM read/write port. The bits 15:8 contain the data byte that
comes from the ITL buffer RAM’s even address. The bits 7:0 contain the data byte
that comes from the ITL buffer RAM’s odd address.
Code (Hex): 40 —
read
Code (Hex): C0 —
write
The HCD must set the byte count into the HcTransferCounter register and check the
HcBufferStatus register before reading from or writing to the buffer. The HCD must
write the command (40H for read, C0H for write) once only, and then read or write
both bytes of the data word. After every read/write, the pointer of ITL buffer RAM will
be automatically increased by two to point to the next data word until it reaches the
value of HcTransferCounter register; otherwise, an internal EOT signal is not
generated to set the bit 2 (AllEOTInterrupt) of the Hc
μ
PInterrupt register and update
the HcBufferStatus register.
The HCD must take care of the fact that the internal buffer RAM is organized in bytes.
The HCD must write the byte count into the HcTransferCounter register, but the HCD
reads or writes the buffer RAM by 16 bits (by 1 data word).
10.6.7
HcATLBufferPort register (R/W: 41H/C1H)
This is the ATL buffer RAM read/write port. The bits 15:8 contain the data byte that
comes from the Acknowledged Transfer List (ATL) buffer RAM’s odd address. Bits 7:0
contain the data byte that comes from the ATL buffer RAM’s even address.
Code (Hex): 41 —
read
Code (Hex): C1 —
write
Table 62:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
HcITLBufferPort register: bit allocation
15
14
13
12
DataWord[15:8]
0
R/W
4
DataWord[7:0]
0
R/W
11
10
9
8
0
0
0
0
0
0
0
R/W
7
R/W
6
R/W
5
R/W
3
R/W
2
R/W
1
R/W
0
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Table 63:
Bit
15 to 0
HcITLBufferPort register: bit description
Symbol
DataWord[15:0]
Description
read/write ITL buffer RAM’s two data bytes.
Table 64:
Bit
Symbol
Reset
Access
HcATLBufferPort register: bit allocation
15
14
13
12
DataWord[15:8]
0
R/W
11
10
9
8
0
0
0
0
0
0
0
R/W
R/W
R/W
R/W
R/W
R/W
R/W
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PDF描述
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