參數(shù)資料
型號(hào)： IDT82P2521BH
廠(chǎng)商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 19/147頁(yè)
文件大?。?/td> 0K
描述： IC LIU E1 21+1CH SHORT 640-PBGA
標(biāo)準(zhǔn)包裝： 5
類(lèi)型： 線(xiàn)路接口裝置（LIU）
規(guī)程： E1
電源電壓： 3.135 V ~ 3.465 V
安裝類(lèi)型： 表面貼裝
封裝/外殼： 640-BGA 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 640-PBGA-EP（31x31）
包裝： 托盤(pán)
其它名稱(chēng)： 82P2521BH
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IDT82P2521
21(+1) CHANNEL HIGH-DENSITY E1 LINE INTERFACE UNIT
Programming Information
115
December 7, 2005
JM - Jitter Measurement Configuration For Channel 0 Register
JIT_PL - Positive Peak Jitter Measurement Low-Byte Register
JIT_PH - Positive Peak Jitter Measurement High-Byte Register
Address: 7E5H
Type: Read / Write
Default Value: 00H
Bit
Name
Description
7 - 3
-
Reserved.
2
JM_STOP
This bit is valid only when the JM_MD bit (b1, JM) is ‘0’.
A transition from ‘0’ to ‘1’ on this bit updates the JIT_PH, JIT_PL and JIT_NH, JIT_NL registers.
This bit must be cleared before the next round.
1
JM_MD
This bit selects the jitter measurement period.
0: The period is determined manually by setting the JM_STOP bit (b2, JM). (default)
1: The period is one second automatically.
0
JM_BW
This bit selects the bandwidth of the measured jitter.
0: 20 Hz ~ 100 KHz. (default)
1: 18 KHz ~ 100 KHz.
Address: 7E6H
Type: Read
Default Value: 00H
Bit
Name
Description
7 - 0
JIT_P[7:0]
These bits, together with the JIT_P[11:8] bits, reflect the greatest positive peak value of the demodulated jitter signal which is
measured by channel 0. They are updated automatically or manually, as determined by the JM_MD bit (b1, JM). They should be
read in the next round of jitter measurement; otherwise, they will be overwritten.
The relationship between the greatest positive peak value and the indication in these bits is:
Positive Peak = [JIT_PH, JIT_PL] / 16 (UIpp)
Address: 7E7H
Type: Read
Default Value: 00H
Bit
Name
Description
7 - 4
-
Reserved.
3 - 0
JIT_P[11:8]
(Refer to the description of the JIT_PL register.)
76
54
3
2
1
0
--
-
JM_STOP
JM_MD
JM_BW
7
654
321
0
JIT_P7
JIT_P6
JIT_P5
JIT_P4
JIT_P3
JIT_P2
JIT_P1
JIT_P0
76
54
3
2
1
0
-
JIT_P11
JIT_P10
JIT_P9
JIT_P8
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PDF描述
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